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blob: 272e00bae8f368dff07852e3b480273e6518a601 [file] [log] [blame]
Tom Rini10e47792018-05-06 17:58:06 -0400[diff] [blame]1/* SPDX-License-Identifier: GPL-2.0+ */
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]2/*
3 * (C) Copyright 2010 Samsung Electronics
4 * Minkyu Kang <mk7.kang@samsung.com>
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]5 */
6
7#ifndef __ASM_ARCH_GPIO_H
8#define __ASM_ARCH_GPIO_H
9
10#ifndef __ASSEMBLY__
11struct s5p_gpio_bank {
12 unsigned int con;
13 unsigned int dat;
14 unsigned int pull;
15 unsigned int drv;
16 unsigned int pdn_con;
17 unsigned int pdn_pull;
18 unsigned char res1[8];
19};
20
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]21/* GPIO pins per bank */
22#define GPIO_PER_BANK 8
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]23
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]24/* A list of valid GPIO numbers for the asm-generic/gpio.h interface */
25enum exynos4_gpio_pin {
26 /* GPIO_PART1_STARTS */
27 EXYNOS4_GPIO_A00, /* 0 */
28 EXYNOS4_GPIO_A01,
29 EXYNOS4_GPIO_A02,
30 EXYNOS4_GPIO_A03,
31 EXYNOS4_GPIO_A04,
32 EXYNOS4_GPIO_A05,
33 EXYNOS4_GPIO_A06,
34 EXYNOS4_GPIO_A07,
35 EXYNOS4_GPIO_A10, /* 8 */
36 EXYNOS4_GPIO_A11,
37 EXYNOS4_GPIO_A12,
38 EXYNOS4_GPIO_A13,
39 EXYNOS4_GPIO_A14,
40 EXYNOS4_GPIO_A15,
41 EXYNOS4_GPIO_A16,
42 EXYNOS4_GPIO_A17,
43 EXYNOS4_GPIO_B0, /* 16 0x10 */
44 EXYNOS4_GPIO_B1,
45 EXYNOS4_GPIO_B2,
46 EXYNOS4_GPIO_B3,
47 EXYNOS4_GPIO_B4,
48 EXYNOS4_GPIO_B5,
49 EXYNOS4_GPIO_B6,
50 EXYNOS4_GPIO_B7,
51 EXYNOS4_GPIO_C00, /* 24 0x18 */
52 EXYNOS4_GPIO_C01,
53 EXYNOS4_GPIO_C02,
54 EXYNOS4_GPIO_C03,
55 EXYNOS4_GPIO_C04,
56 EXYNOS4_GPIO_C05,
57 EXYNOS4_GPIO_C06,
58 EXYNOS4_GPIO_C07,
59 EXYNOS4_GPIO_C10, /* 32 0x20*/
60 EXYNOS4_GPIO_C11,
61 EXYNOS4_GPIO_C12,
62 EXYNOS4_GPIO_C13,
63 EXYNOS4_GPIO_C14,
64 EXYNOS4_GPIO_C15,
65 EXYNOS4_GPIO_C16,
66 EXYNOS4_GPIO_C17,
67 EXYNOS4_GPIO_D00, /* 40 0x28 */
68 EXYNOS4_GPIO_D01,
69 EXYNOS4_GPIO_D02,
70 EXYNOS4_GPIO_D03,
71 EXYNOS4_GPIO_D04,
72 EXYNOS4_GPIO_D05,
73 EXYNOS4_GPIO_D06,
74 EXYNOS4_GPIO_D07,
75 EXYNOS4_GPIO_D10, /* 48 0x30 */
76 EXYNOS4_GPIO_D11,
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79 EXYNOS4_GPIO_D14,
80 EXYNOS4_GPIO_D15,
81 EXYNOS4_GPIO_D16,
82 EXYNOS4_GPIO_D17,
83 EXYNOS4_GPIO_E00, /* 56 0x38 */
84 EXYNOS4_GPIO_E01,
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90 EXYNOS4_GPIO_E07,
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92 EXYNOS4_GPIO_E11,
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94 EXYNOS4_GPIO_E13,
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99 EXYNOS4_GPIO_E20, /* 72 0x48 */
100 EXYNOS4_GPIO_E21,
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103 EXYNOS4_GPIO_E24,
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112 EXYNOS4_GPIO_E35,
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150 EXYNOS4_GPIO_F33,
151 EXYNOS4_GPIO_F34,
152 EXYNOS4_GPIO_F35,
153 EXYNOS4_GPIO_F36,
154 EXYNOS4_GPIO_F37,
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]155
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]156 /* GPIO_PART2_STARTS */
157 EXYNOS4_GPIO_MAX_PORT_PART_1, /* 128 0x80 */
158 EXYNOS4_GPIO_J00 = EXYNOS4_GPIO_MAX_PORT_PART_1,
159 EXYNOS4_GPIO_J01,
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283 EXYNOS4_GPIO_Y65,
284 EXYNOS4_GPIO_Y66,
285 EXYNOS4_GPIO_Y67,
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]286
287 /* GPIO_PART2_1 STARTS */
288 EXYNOS4_GPIO_MAX_PORT_PART_2_0, /* 256 0x100 */
289 EXYNOS4_GPIO_X00 = EXYNOS4_GPIO_MAX_PORT_PART_2_0,
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291 EXYNOS4_GPIO_X02,
292 EXYNOS4_GPIO_X03,
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294 EXYNOS4_GPIO_X05,
295 EXYNOS4_GPIO_X06,
296 EXYNOS4_GPIO_X07,
Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]297 EXYNOS4_GPIO_X10, /* 264 0x108 */
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299 EXYNOS4_GPIO_X12,
300 EXYNOS4_GPIO_X13,
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303 EXYNOS4_GPIO_X16,
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Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]305 EXYNOS4_GPIO_X20, /* 272 0x110 */
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Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]313 EXYNOS4_GPIO_X30, /* 280 0x118 */
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315 EXYNOS4_GPIO_X32,
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317 EXYNOS4_GPIO_X34,
318 EXYNOS4_GPIO_X35,
319 EXYNOS4_GPIO_X36,
320 EXYNOS4_GPIO_X37,
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]321
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]322 /* GPIO_PART3_STARTS */
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]323 EXYNOS4_GPIO_MAX_PORT_PART_2_1, /* 288 0x120 */
324 EXYNOS4_GPIO_Z0 = EXYNOS4_GPIO_MAX_PORT_PART_2_1,
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Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]333 EXYNOS4_GPIO_MAX_PORT
Chander Kashyap252991e2012-12-25 20:13:42 +0000[diff] [blame]334};
335
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]336enum exynos4X12_gpio_pin {
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]337 /* EXYNOS4X12_GPIO_PART1_0 starts here */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]338 EXYNOS4X12_GPIO_A00, /* 0 */
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387 EXYNOS4X12_GPIO_D11,
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1361};
Chander Kashyap252991e2012-12-25 20:13:42 +0000[diff] [blame]1362
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]1363#define EXYNOS4X12_GPIO_NUM_PARTS 8
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1364static struct gpio_info exynos4x12_gpio_data[EXYNOS4X12_GPIO_NUM_PARTS] = {
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]1365 { EXYNOS4X12_GPIO_PART1_0, EXYNOS4X12_GPIO_MAX_PORT_PART_1_0 },
1366 { EXYNOS4X12_GPIO_PART1_1, EXYNOS4X12_GPIO_MAX_PORT_PART_1_1 },
1367 { EXYNOS4X12_GPIO_PART1_2, EXYNOS4X12_GPIO_MAX_PORT_PART_1_2 },
1368 { EXYNOS4X12_GPIO_PART2_1, EXYNOS4X12_GPIO_MAX_PORT_PART_2_1 },
1369 { EXYNOS4X12_GPIO_PART2_2, EXYNOS4X12_GPIO_MAX_PORT_PART_2_2 },
1370 { EXYNOS4X12_GPIO_PART2_3, EXYNOS4X12_GPIO_MAX_PORT_PART_2_3 },
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1371 { EXYNOS4X12_GPIO_PART3_BASE, EXYNOS4X12_GPIO_MAX_PORT_PART_3 },
1372 { EXYNOS4X12_GPIO_PART4_BASE, EXYNOS4X12_GPIO_MAX_PORT },
1373};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1374
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1375#define EXYNOS5_GPIO_NUM_PARTS 8
1376static struct gpio_info exynos5_gpio_data[EXYNOS5_GPIO_NUM_PARTS] = {
1377 { EXYNOS5_GPIO_PART1_BASE, EXYNOS5_GPIO_MAX_PORT_PART_1 },
1378 { EXYNOS5_GPIO_PART2_BASE, EXYNOS5_GPIO_MAX_PORT_PART_2 },
1379 { EXYNOS5_GPIO_PART3_BASE, EXYNOS5_GPIO_MAX_PORT_PART_3 },
1380 { EXYNOS5_GPIO_PART4_BASE, EXYNOS5_GPIO_MAX_PORT_PART_4 },
1381 { EXYNOS5_GPIO_PART5_BASE, EXYNOS5_GPIO_MAX_PORT_PART_5 },
1382 { EXYNOS5_GPIO_PART6_BASE, EXYNOS5_GPIO_MAX_PORT_PART_6 },
1383 { EXYNOS5_GPIO_PART7_BASE, EXYNOS5_GPIO_MAX_PORT_PART_7 },
1384 { EXYNOS5_GPIO_PART8_BASE, EXYNOS5_GPIO_MAX_PORT },
1385};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1386
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1387#define EXYNOS5420_GPIO_NUM_PARTS 6
1388static struct gpio_info exynos5420_gpio_data[EXYNOS5420_GPIO_NUM_PARTS] = {
1389 { EXYNOS5420_GPIO_PART1_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_1 },
1390 { EXYNOS5420_GPIO_PART2_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_2 },
1391 { EXYNOS5420_GPIO_PART3_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_3 },
1392 { EXYNOS5420_GPIO_PART4_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_4 },
1393 { EXYNOS5420_GPIO_PART5_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_5 },
1394 { EXYNOS5420_GPIO_PART6_BASE, EXYNOS5420_GPIO_MAX_PORT },
1395};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1396
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1397static inline struct gpio_info *get_gpio_data(void)
Łukasz Majewski1e04cae2011-08-22 22:34:58 +0000[diff] [blame]1398{
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1399 if (cpu_is_exynos5()) {
Przemyslaw Marczakcefbfe42015-10-27 13:07:57 +0100[diff] [blame]1400 if (proid_is_exynos5420() || proid_is_exynos5422())
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1401 return exynos5420_gpio_data;
1402 else
1403 return exynos5_gpio_data;
1404 } else if (cpu_is_exynos4()) {
1405 if (proid_is_exynos4412())
1406 return exynos4x12_gpio_data;
1407 else
1408 return exynos4_gpio_data;
1409 }
Łukasz Majewski1e04cae2011-08-22 22:34:58 +0000[diff] [blame]1410
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1411 return NULL;
1412}
1413
1414static inline unsigned int get_bank_num(void)
1415{
1416 if (cpu_is_exynos5()) {
Przemyslaw Marczakcefbfe42015-10-27 13:07:57 +0100[diff] [blame]1417 if (proid_is_exynos5420() || proid_is_exynos5422())
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1418 return EXYNOS5420_GPIO_NUM_PARTS;
1419 else
1420 return EXYNOS5_GPIO_NUM_PARTS;
1421 } else if (cpu_is_exynos4()) {
1422 if (proid_is_exynos4412())
1423 return EXYNOS4X12_GPIO_NUM_PARTS;
1424 else
1425 return EXYNOS4_GPIO_NUM_PARTS;
Łukasz Majewskid6614b72012-09-04 21:47:46 +0000[diff] [blame]1426 }
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1427
1428 return 0;
Łukasz Majewskid6614b72012-09-04 21:47:46 +0000[diff] [blame]1429}
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1430
1431/*
1432 * This structure helps mapping symbolic GPIO names into indices from
1433 * exynos5_gpio_pin/exynos5420_gpio_pin enums.
1434 *
1435 * By convention, symbolic GPIO name is defined as follows:
1436 *
1437 * g[p]<bank><set><bit>, where
1438 * p is optional
1439 * <bank> - a single character bank name, as defined by the SOC
1440 * <set> - a single digit set number
1441 * <bit> - bit number within the set (in 0..7 range).
1442 *
1443 * <set><bit> essentially form an octal number of the GPIO pin within the bank
1444 * space. On the 5420 architecture some banks' sets do not start not from zero
1445 * ('d' starts from 1 and 'j' starts from 4). To compensate for that and
1446 * maintain flat number space withoout holes, those banks use offsets to be
1447 * deducted from the pin number.
1448 */
1449struct gpio_name_num_table {
1450 char bank; /* bank name symbol */
1451 unsigned int bank_size; /* total number of pins in the bank */
1452 char bank_offset; /* offset of the first bank's pin */
1453 unsigned int base; /* index of the first bank's pin in the enum */
1454};
1455
1456#define GPIO_ENTRY(name, base, top, offset) { name, top - base, offset, base }
1457static const struct gpio_name_num_table exynos4_gpio_table[] = {
1458 GPIO_ENTRY('a', EXYNOS4_GPIO_A00, EXYNOS4_GPIO_B0, 0),
1459 GPIO_ENTRY('b', EXYNOS4_GPIO_B0, EXYNOS4_GPIO_C00, 0),
1460 GPIO_ENTRY('c', EXYNOS4_GPIO_C00, EXYNOS4_GPIO_D00, 0),
1461 GPIO_ENTRY('d', EXYNOS4_GPIO_D00, EXYNOS4_GPIO_E00, 0),
1462 GPIO_ENTRY('e', EXYNOS4_GPIO_E00, EXYNOS4_GPIO_F00, 0),
1463 GPIO_ENTRY('f', EXYNOS4_GPIO_F00, EXYNOS4_GPIO_J00, 0),
1464 GPIO_ENTRY('j', EXYNOS4_GPIO_J00, EXYNOS4_GPIO_K00, 0),
1465 GPIO_ENTRY('k', EXYNOS4_GPIO_K00, EXYNOS4_GPIO_L00, 0),
1466 GPIO_ENTRY('l', EXYNOS4_GPIO_L00, EXYNOS4_GPIO_Y00, 0),
1467 GPIO_ENTRY('y', EXYNOS4_GPIO_Y00, EXYNOS4_GPIO_X00, 0),
1468 GPIO_ENTRY('x', EXYNOS4_GPIO_X00, EXYNOS4_GPIO_Z0, 0),
1469 GPIO_ENTRY('z', EXYNOS4_GPIO_Z0, EXYNOS4_GPIO_MAX_PORT, 0),
1470 { 0 }
1471};
1472
1473static const struct gpio_name_num_table exynos4x12_gpio_table[] = {
1474 GPIO_ENTRY('a', EXYNOS4X12_GPIO_A00, EXYNOS4X12_GPIO_B0, 0),
1475 GPIO_ENTRY('b', EXYNOS4X12_GPIO_B0, EXYNOS4X12_GPIO_C00, 0),
1476 GPIO_ENTRY('c', EXYNOS4X12_GPIO_C00, EXYNOS4X12_GPIO_D00, 0),
1477 GPIO_ENTRY('d', EXYNOS4X12_GPIO_D00, EXYNOS4X12_GPIO_F00, 0),
1478 GPIO_ENTRY('f', EXYNOS4X12_GPIO_F00, EXYNOS4X12_GPIO_J00, 0),
1479 GPIO_ENTRY('j', EXYNOS4X12_GPIO_J00, EXYNOS4X12_GPIO_K00, 0),
1480 GPIO_ENTRY('k', EXYNOS4X12_GPIO_K00, EXYNOS4X12_GPIO_L00, 0),
1481 GPIO_ENTRY('l', EXYNOS4X12_GPIO_L00, EXYNOS4X12_GPIO_Y00, 0),
1482 GPIO_ENTRY('y', EXYNOS4X12_GPIO_Y00, EXYNOS4X12_GPIO_M00, 0),
1483 GPIO_ENTRY('m', EXYNOS4X12_GPIO_M00, EXYNOS4X12_GPIO_X00, 0),
1484 GPIO_ENTRY('x', EXYNOS4X12_GPIO_X00, EXYNOS4X12_GPIO_Z0, 0),
1485 GPIO_ENTRY('z', EXYNOS4X12_GPIO_Z0, EXYNOS4X12_GPIO_V00, 0),
1486 GPIO_ENTRY('v', EXYNOS4X12_GPIO_V00, EXYNOS4X12_GPIO_MAX_PORT, 0),
1487 { 0 }
1488};
1489
1490static const struct gpio_name_num_table exynos5_gpio_table[] = {
1491 GPIO_ENTRY('a', EXYNOS5_GPIO_A00, EXYNOS5_GPIO_B00, 0),
1492 GPIO_ENTRY('b', EXYNOS5_GPIO_B00, EXYNOS5_GPIO_C00, 0),
1493 GPIO_ENTRY('c', EXYNOS5_GPIO_C00, EXYNOS5_GPIO_D00, 0),
1494 GPIO_ENTRY('d', EXYNOS5_GPIO_D00, EXYNOS5_GPIO_Y00, 0),
1495 GPIO_ENTRY('y', EXYNOS5_GPIO_Y00, EXYNOS5_GPIO_C40, 0),
1496 GPIO_ENTRY('x', EXYNOS5_GPIO_X00, EXYNOS5_GPIO_E00, 0),
1497 GPIO_ENTRY('e', EXYNOS5_GPIO_E00, EXYNOS5_GPIO_F00, 0),
1498 GPIO_ENTRY('f', EXYNOS5_GPIO_F00, EXYNOS5_GPIO_G00, 0),
1499 GPIO_ENTRY('g', EXYNOS5_GPIO_G00, EXYNOS5_GPIO_H00, 0),
1500 GPIO_ENTRY('h', EXYNOS5_GPIO_H00, EXYNOS5_GPIO_V00, 0),
1501 GPIO_ENTRY('v', EXYNOS5_GPIO_V00, EXYNOS5_GPIO_Z0, 0),
1502 GPIO_ENTRY('z', EXYNOS5_GPIO_Z0, EXYNOS5_GPIO_MAX_PORT, 0),
1503 { 0 }
1504};
1505
1506static const struct gpio_name_num_table exynos5420_gpio_table[] = {
1507 GPIO_ENTRY('a', EXYNOS5420_GPIO_A00, EXYNOS5420_GPIO_B00, 0),
1508 GPIO_ENTRY('b', EXYNOS5420_GPIO_B00, EXYNOS5420_GPIO_H00, 0),
1509 GPIO_ENTRY('h', EXYNOS5420_GPIO_H00, EXYNOS5420_GPIO_Y70, 0),
1510 GPIO_ENTRY('x', EXYNOS5420_GPIO_X00, EXYNOS5420_GPIO_C00, 0),
1511 GPIO_ENTRY('c', EXYNOS5420_GPIO_C00, EXYNOS5420_GPIO_D10, 0),
1512 GPIO_ENTRY('d', EXYNOS5420_GPIO_D10, EXYNOS5420_GPIO_Y00, 010),
1513 GPIO_ENTRY('y', EXYNOS5420_GPIO_Y00, EXYNOS5420_GPIO_E00, 0),
1514 GPIO_ENTRY('e', EXYNOS5420_GPIO_E00, EXYNOS5420_GPIO_F00, 0),
1515 GPIO_ENTRY('f', EXYNOS5420_GPIO_F00, EXYNOS5420_GPIO_G00, 0),
1516 GPIO_ENTRY('g', EXYNOS5420_GPIO_G00, EXYNOS5420_GPIO_J40, 0),
1517 GPIO_ENTRY('j', EXYNOS5420_GPIO_J40, EXYNOS5420_GPIO_Z0, 040),
1518 GPIO_ENTRY('z', EXYNOS5420_GPIO_Z0, EXYNOS5420_GPIO_MAX_PORT, 0),
1519 { 0 }
1520};
1521
1522void gpio_cfg_pin(int gpio, int cfg);
1523void gpio_set_pull(int gpio, int mode);
1524void gpio_set_drv(int gpio, int mode);
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1525void gpio_set_rate(int gpio, int mode);
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1526int s5p_gpio_get_pin(unsigned gpio);
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1527#endif
1528
1529/* Pin configurations */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1530#define S5P_GPIO_INPUT 0x0
1531#define S5P_GPIO_OUTPUT 0x1
1532#define S5P_GPIO_IRQ 0xf
1533#define S5P_GPIO_FUNC(x) (x)
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1534
1535/* Pull mode */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1536#define S5P_GPIO_PULL_NONE 0x0
1537#define S5P_GPIO_PULL_DOWN 0x1
1538#define S5P_GPIO_PULL_UP 0x3
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1539
1540/* Drive Strength level */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1541#define S5P_GPIO_DRV_1X 0x0
1542#define S5P_GPIO_DRV_3X 0x1
1543#define S5P_GPIO_DRV_2X 0x2
1544#define S5P_GPIO_DRV_4X 0x3
1545#define S5P_GPIO_DRV_FAST 0x0
1546#define S5P_GPIO_DRV_SLOW 0x1
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1547#endif