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blob: 7fc8e61f9ca8e9b070f2d120e1dd3960f1566600 [file] [log] [blame]
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1/*
2 * (C) Copyright 2010 Samsung Electronics
3 * Minkyu Kang <mk7.kang@samsung.com>
4 *
Wolfgang Denkd79de1d2013-07-08 09:37:19 +0200[diff] [blame]5 * SPDX-License-Identifier: GPL-2.0+
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7
8#ifndef __ASM_ARCH_GPIO_H
9#define __ASM_ARCH_GPIO_H
10
11#ifndef __ASSEMBLY__
12struct s5p_gpio_bank {
13 unsigned int con;
14 unsigned int dat;
15 unsigned int pull;
16 unsigned int drv;
17 unsigned int pdn_con;
18 unsigned int pdn_pull;
19 unsigned char res1[8];
20};
21
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]22/* GPIO pins per bank */
23#define GPIO_PER_BANK 8
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]24
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]25/* A list of valid GPIO numbers for the asm-generic/gpio.h interface */
26enum exynos4_gpio_pin {
27 /* GPIO_PART1_STARTS */
28 EXYNOS4_GPIO_A00, /* 0 */
29 EXYNOS4_GPIO_A01,
30 EXYNOS4_GPIO_A02,
31 EXYNOS4_GPIO_A03,
32 EXYNOS4_GPIO_A04,
33 EXYNOS4_GPIO_A05,
34 EXYNOS4_GPIO_A06,
35 EXYNOS4_GPIO_A07,
36 EXYNOS4_GPIO_A10, /* 8 */
37 EXYNOS4_GPIO_A11,
38 EXYNOS4_GPIO_A12,
39 EXYNOS4_GPIO_A13,
40 EXYNOS4_GPIO_A14,
41 EXYNOS4_GPIO_A15,
42 EXYNOS4_GPIO_A16,
43 EXYNOS4_GPIO_A17,
44 EXYNOS4_GPIO_B0, /* 16 0x10 */
45 EXYNOS4_GPIO_B1,
46 EXYNOS4_GPIO_B2,
47 EXYNOS4_GPIO_B3,
48 EXYNOS4_GPIO_B4,
49 EXYNOS4_GPIO_B5,
50 EXYNOS4_GPIO_B6,
51 EXYNOS4_GPIO_B7,
52 EXYNOS4_GPIO_C00, /* 24 0x18 */
53 EXYNOS4_GPIO_C01,
54 EXYNOS4_GPIO_C02,
55 EXYNOS4_GPIO_C03,
56 EXYNOS4_GPIO_C04,
57 EXYNOS4_GPIO_C05,
58 EXYNOS4_GPIO_C06,
59 EXYNOS4_GPIO_C07,
60 EXYNOS4_GPIO_C10, /* 32 0x20*/
61 EXYNOS4_GPIO_C11,
62 EXYNOS4_GPIO_C12,
63 EXYNOS4_GPIO_C13,
64 EXYNOS4_GPIO_C14,
65 EXYNOS4_GPIO_C15,
66 EXYNOS4_GPIO_C16,
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68 EXYNOS4_GPIO_D00, /* 40 0x28 */
69 EXYNOS4_GPIO_D01,
70 EXYNOS4_GPIO_D02,
71 EXYNOS4_GPIO_D03,
72 EXYNOS4_GPIO_D04,
73 EXYNOS4_GPIO_D05,
74 EXYNOS4_GPIO_D06,
75 EXYNOS4_GPIO_D07,
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79 EXYNOS4_GPIO_D13,
80 EXYNOS4_GPIO_D14,
81 EXYNOS4_GPIO_D15,
82 EXYNOS4_GPIO_D16,
83 EXYNOS4_GPIO_D17,
84 EXYNOS4_GPIO_E00, /* 56 0x38 */
85 EXYNOS4_GPIO_E01,
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90 EXYNOS4_GPIO_E06,
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93 EXYNOS4_GPIO_E11,
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100 EXYNOS4_GPIO_E20, /* 72 0x48 */
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110 EXYNOS4_GPIO_E32,
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133 EXYNOS4_GPIO_F11,
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149 EXYNOS4_GPIO_F31,
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151 EXYNOS4_GPIO_F33,
152 EXYNOS4_GPIO_F34,
153 EXYNOS4_GPIO_F35,
154 EXYNOS4_GPIO_F36,
155 EXYNOS4_GPIO_F37,
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Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]157 /* GPIO_PART2_STARTS */
158 EXYNOS4_GPIO_MAX_PORT_PART_1, /* 128 0x80 */
159 EXYNOS4_GPIO_J00 = EXYNOS4_GPIO_MAX_PORT_PART_1,
160 EXYNOS4_GPIO_J01,
161 EXYNOS4_GPIO_J02,
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168 EXYNOS4_GPIO_J11,
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200 EXYNOS4_GPIO_K31,
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211 EXYNOS4_GPIO_L04,
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280 EXYNOS4_GPIO_Y61,
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283 EXYNOS4_GPIO_Y64,
284 EXYNOS4_GPIO_Y65,
285 EXYNOS4_GPIO_Y66,
286 EXYNOS4_GPIO_Y67,
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]287
288 /* GPIO_PART2_1 STARTS */
289 EXYNOS4_GPIO_MAX_PORT_PART_2_0, /* 256 0x100 */
290 EXYNOS4_GPIO_X00 = EXYNOS4_GPIO_MAX_PORT_PART_2_0,
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292 EXYNOS4_GPIO_X02,
293 EXYNOS4_GPIO_X03,
294 EXYNOS4_GPIO_X04,
295 EXYNOS4_GPIO_X05,
296 EXYNOS4_GPIO_X06,
297 EXYNOS4_GPIO_X07,
Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]298 EXYNOS4_GPIO_X10, /* 264 0x108 */
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300 EXYNOS4_GPIO_X12,
301 EXYNOS4_GPIO_X13,
302 EXYNOS4_GPIO_X14,
303 EXYNOS4_GPIO_X15,
304 EXYNOS4_GPIO_X16,
305 EXYNOS4_GPIO_X17,
Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]306 EXYNOS4_GPIO_X20, /* 272 0x110 */
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308 EXYNOS4_GPIO_X22,
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313 EXYNOS4_GPIO_X27,
Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]314 EXYNOS4_GPIO_X30, /* 280 0x118 */
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316 EXYNOS4_GPIO_X32,
317 EXYNOS4_GPIO_X33,
318 EXYNOS4_GPIO_X34,
319 EXYNOS4_GPIO_X35,
320 EXYNOS4_GPIO_X36,
321 EXYNOS4_GPIO_X37,
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]322
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]323 /* GPIO_PART3_STARTS */
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]324 EXYNOS4_GPIO_MAX_PORT_PART_2_1, /* 288 0x120 */
325 EXYNOS4_GPIO_Z0 = EXYNOS4_GPIO_MAX_PORT_PART_2_1,
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327 EXYNOS4_GPIO_Z2,
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330 EXYNOS4_GPIO_Z5,
331 EXYNOS4_GPIO_Z6,
332 EXYNOS4_GPIO_Z7,
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Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]334 EXYNOS4_GPIO_MAX_PORT
Chander Kashyap252991e2012-12-25 20:13:42 +0000[diff] [blame]335};
336
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]337enum exynos4X12_gpio_pin {
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]338 /* EXYNOS4X12_GPIO_PART1_0 starts here */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]339 EXYNOS4X12_GPIO_A00, /* 0 */
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342 EXYNOS4X12_GPIO_A03,
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348 EXYNOS4X12_GPIO_A11,
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1362};
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Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]1364#define EXYNOS4X12_GPIO_NUM_PARTS 8
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1365static struct gpio_info exynos4x12_gpio_data[EXYNOS4X12_GPIO_NUM_PARTS] = {
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]1366 { EXYNOS4X12_GPIO_PART1_0, EXYNOS4X12_GPIO_MAX_PORT_PART_1_0 },
1367 { EXYNOS4X12_GPIO_PART1_1, EXYNOS4X12_GPIO_MAX_PORT_PART_1_1 },
1368 { EXYNOS4X12_GPIO_PART1_2, EXYNOS4X12_GPIO_MAX_PORT_PART_1_2 },
1369 { EXYNOS4X12_GPIO_PART2_1, EXYNOS4X12_GPIO_MAX_PORT_PART_2_1 },
1370 { EXYNOS4X12_GPIO_PART2_2, EXYNOS4X12_GPIO_MAX_PORT_PART_2_2 },
1371 { EXYNOS4X12_GPIO_PART2_3, EXYNOS4X12_GPIO_MAX_PORT_PART_2_3 },
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1372 { EXYNOS4X12_GPIO_PART3_BASE, EXYNOS4X12_GPIO_MAX_PORT_PART_3 },
1373 { EXYNOS4X12_GPIO_PART4_BASE, EXYNOS4X12_GPIO_MAX_PORT },
1374};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1375
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1376#define EXYNOS5_GPIO_NUM_PARTS 8
1377static struct gpio_info exynos5_gpio_data[EXYNOS5_GPIO_NUM_PARTS] = {
1378 { EXYNOS5_GPIO_PART1_BASE, EXYNOS5_GPIO_MAX_PORT_PART_1 },
1379 { EXYNOS5_GPIO_PART2_BASE, EXYNOS5_GPIO_MAX_PORT_PART_2 },
1380 { EXYNOS5_GPIO_PART3_BASE, EXYNOS5_GPIO_MAX_PORT_PART_3 },
1381 { EXYNOS5_GPIO_PART4_BASE, EXYNOS5_GPIO_MAX_PORT_PART_4 },
1382 { EXYNOS5_GPIO_PART5_BASE, EXYNOS5_GPIO_MAX_PORT_PART_5 },
1383 { EXYNOS5_GPIO_PART6_BASE, EXYNOS5_GPIO_MAX_PORT_PART_6 },
1384 { EXYNOS5_GPIO_PART7_BASE, EXYNOS5_GPIO_MAX_PORT_PART_7 },
1385 { EXYNOS5_GPIO_PART8_BASE, EXYNOS5_GPIO_MAX_PORT },
1386};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1387
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1388#define EXYNOS5420_GPIO_NUM_PARTS 6
1389static struct gpio_info exynos5420_gpio_data[EXYNOS5420_GPIO_NUM_PARTS] = {
1390 { EXYNOS5420_GPIO_PART1_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_1 },
1391 { EXYNOS5420_GPIO_PART2_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_2 },
1392 { EXYNOS5420_GPIO_PART3_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_3 },
1393 { EXYNOS5420_GPIO_PART4_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_4 },
1394 { EXYNOS5420_GPIO_PART5_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_5 },
1395 { EXYNOS5420_GPIO_PART6_BASE, EXYNOS5420_GPIO_MAX_PORT },
1396};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1397
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1398static inline struct gpio_info *get_gpio_data(void)
Łukasz Majewski1e04cae2011-08-22 22:34:58 +0000[diff] [blame]1399{
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1400 if (cpu_is_exynos5()) {
Przemyslaw Marczakcefbfe42015-10-27 13:07:57 +0100[diff] [blame]1401 if (proid_is_exynos5420() || proid_is_exynos5422())
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1402 return exynos5420_gpio_data;
1403 else
1404 return exynos5_gpio_data;
1405 } else if (cpu_is_exynos4()) {
1406 if (proid_is_exynos4412())
1407 return exynos4x12_gpio_data;
1408 else
1409 return exynos4_gpio_data;
1410 }
Łukasz Majewski1e04cae2011-08-22 22:34:58 +0000[diff] [blame]1411
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1412 return NULL;
1413}
1414
1415static inline unsigned int get_bank_num(void)
1416{
1417 if (cpu_is_exynos5()) {
Przemyslaw Marczakcefbfe42015-10-27 13:07:57 +0100[diff] [blame]1418 if (proid_is_exynos5420() || proid_is_exynos5422())
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1419 return EXYNOS5420_GPIO_NUM_PARTS;
1420 else
1421 return EXYNOS5_GPIO_NUM_PARTS;
1422 } else if (cpu_is_exynos4()) {
1423 if (proid_is_exynos4412())
1424 return EXYNOS4X12_GPIO_NUM_PARTS;
1425 else
1426 return EXYNOS4_GPIO_NUM_PARTS;
Łukasz Majewskid6614b72012-09-04 21:47:46 +0000[diff] [blame]1427 }
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1428
1429 return 0;
Łukasz Majewskid6614b72012-09-04 21:47:46 +0000[diff] [blame]1430}
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1431
1432/*
1433 * This structure helps mapping symbolic GPIO names into indices from
1434 * exynos5_gpio_pin/exynos5420_gpio_pin enums.
1435 *
1436 * By convention, symbolic GPIO name is defined as follows:
1437 *
1438 * g[p]<bank><set><bit>, where
1439 * p is optional
1440 * <bank> - a single character bank name, as defined by the SOC
1441 * <set> - a single digit set number
1442 * <bit> - bit number within the set (in 0..7 range).
1443 *
1444 * <set><bit> essentially form an octal number of the GPIO pin within the bank
1445 * space. On the 5420 architecture some banks' sets do not start not from zero
1446 * ('d' starts from 1 and 'j' starts from 4). To compensate for that and
1447 * maintain flat number space withoout holes, those banks use offsets to be
1448 * deducted from the pin number.
1449 */
1450struct gpio_name_num_table {
1451 char bank; /* bank name symbol */
1452 unsigned int bank_size; /* total number of pins in the bank */
1453 char bank_offset; /* offset of the first bank's pin */
1454 unsigned int base; /* index of the first bank's pin in the enum */
1455};
1456
1457#define GPIO_ENTRY(name, base, top, offset) { name, top - base, offset, base }
1458static const struct gpio_name_num_table exynos4_gpio_table[] = {
1459 GPIO_ENTRY('a', EXYNOS4_GPIO_A00, EXYNOS4_GPIO_B0, 0),
1460 GPIO_ENTRY('b', EXYNOS4_GPIO_B0, EXYNOS4_GPIO_C00, 0),
1461 GPIO_ENTRY('c', EXYNOS4_GPIO_C00, EXYNOS4_GPIO_D00, 0),
1462 GPIO_ENTRY('d', EXYNOS4_GPIO_D00, EXYNOS4_GPIO_E00, 0),
1463 GPIO_ENTRY('e', EXYNOS4_GPIO_E00, EXYNOS4_GPIO_F00, 0),
1464 GPIO_ENTRY('f', EXYNOS4_GPIO_F00, EXYNOS4_GPIO_J00, 0),
1465 GPIO_ENTRY('j', EXYNOS4_GPIO_J00, EXYNOS4_GPIO_K00, 0),
1466 GPIO_ENTRY('k', EXYNOS4_GPIO_K00, EXYNOS4_GPIO_L00, 0),
1467 GPIO_ENTRY('l', EXYNOS4_GPIO_L00, EXYNOS4_GPIO_Y00, 0),
1468 GPIO_ENTRY('y', EXYNOS4_GPIO_Y00, EXYNOS4_GPIO_X00, 0),
1469 GPIO_ENTRY('x', EXYNOS4_GPIO_X00, EXYNOS4_GPIO_Z0, 0),
1470 GPIO_ENTRY('z', EXYNOS4_GPIO_Z0, EXYNOS4_GPIO_MAX_PORT, 0),
1471 { 0 }
1472};
1473
1474static const struct gpio_name_num_table exynos4x12_gpio_table[] = {
1475 GPIO_ENTRY('a', EXYNOS4X12_GPIO_A00, EXYNOS4X12_GPIO_B0, 0),
1476 GPIO_ENTRY('b', EXYNOS4X12_GPIO_B0, EXYNOS4X12_GPIO_C00, 0),
1477 GPIO_ENTRY('c', EXYNOS4X12_GPIO_C00, EXYNOS4X12_GPIO_D00, 0),
1478 GPIO_ENTRY('d', EXYNOS4X12_GPIO_D00, EXYNOS4X12_GPIO_F00, 0),
1479 GPIO_ENTRY('f', EXYNOS4X12_GPIO_F00, EXYNOS4X12_GPIO_J00, 0),
1480 GPIO_ENTRY('j', EXYNOS4X12_GPIO_J00, EXYNOS4X12_GPIO_K00, 0),
1481 GPIO_ENTRY('k', EXYNOS4X12_GPIO_K00, EXYNOS4X12_GPIO_L00, 0),
1482 GPIO_ENTRY('l', EXYNOS4X12_GPIO_L00, EXYNOS4X12_GPIO_Y00, 0),
1483 GPIO_ENTRY('y', EXYNOS4X12_GPIO_Y00, EXYNOS4X12_GPIO_M00, 0),
1484 GPIO_ENTRY('m', EXYNOS4X12_GPIO_M00, EXYNOS4X12_GPIO_X00, 0),
1485 GPIO_ENTRY('x', EXYNOS4X12_GPIO_X00, EXYNOS4X12_GPIO_Z0, 0),
1486 GPIO_ENTRY('z', EXYNOS4X12_GPIO_Z0, EXYNOS4X12_GPIO_V00, 0),
1487 GPIO_ENTRY('v', EXYNOS4X12_GPIO_V00, EXYNOS4X12_GPIO_MAX_PORT, 0),
1488 { 0 }
1489};
1490
1491static const struct gpio_name_num_table exynos5_gpio_table[] = {
1492 GPIO_ENTRY('a', EXYNOS5_GPIO_A00, EXYNOS5_GPIO_B00, 0),
1493 GPIO_ENTRY('b', EXYNOS5_GPIO_B00, EXYNOS5_GPIO_C00, 0),
1494 GPIO_ENTRY('c', EXYNOS5_GPIO_C00, EXYNOS5_GPIO_D00, 0),
1495 GPIO_ENTRY('d', EXYNOS5_GPIO_D00, EXYNOS5_GPIO_Y00, 0),
1496 GPIO_ENTRY('y', EXYNOS5_GPIO_Y00, EXYNOS5_GPIO_C40, 0),
1497 GPIO_ENTRY('x', EXYNOS5_GPIO_X00, EXYNOS5_GPIO_E00, 0),
1498 GPIO_ENTRY('e', EXYNOS5_GPIO_E00, EXYNOS5_GPIO_F00, 0),
1499 GPIO_ENTRY('f', EXYNOS5_GPIO_F00, EXYNOS5_GPIO_G00, 0),
1500 GPIO_ENTRY('g', EXYNOS5_GPIO_G00, EXYNOS5_GPIO_H00, 0),
1501 GPIO_ENTRY('h', EXYNOS5_GPIO_H00, EXYNOS5_GPIO_V00, 0),
1502 GPIO_ENTRY('v', EXYNOS5_GPIO_V00, EXYNOS5_GPIO_Z0, 0),
1503 GPIO_ENTRY('z', EXYNOS5_GPIO_Z0, EXYNOS5_GPIO_MAX_PORT, 0),
1504 { 0 }
1505};
1506
1507static const struct gpio_name_num_table exynos5420_gpio_table[] = {
1508 GPIO_ENTRY('a', EXYNOS5420_GPIO_A00, EXYNOS5420_GPIO_B00, 0),
1509 GPIO_ENTRY('b', EXYNOS5420_GPIO_B00, EXYNOS5420_GPIO_H00, 0),
1510 GPIO_ENTRY('h', EXYNOS5420_GPIO_H00, EXYNOS5420_GPIO_Y70, 0),
1511 GPIO_ENTRY('x', EXYNOS5420_GPIO_X00, EXYNOS5420_GPIO_C00, 0),
1512 GPIO_ENTRY('c', EXYNOS5420_GPIO_C00, EXYNOS5420_GPIO_D10, 0),
1513 GPIO_ENTRY('d', EXYNOS5420_GPIO_D10, EXYNOS5420_GPIO_Y00, 010),
1514 GPIO_ENTRY('y', EXYNOS5420_GPIO_Y00, EXYNOS5420_GPIO_E00, 0),
1515 GPIO_ENTRY('e', EXYNOS5420_GPIO_E00, EXYNOS5420_GPIO_F00, 0),
1516 GPIO_ENTRY('f', EXYNOS5420_GPIO_F00, EXYNOS5420_GPIO_G00, 0),
1517 GPIO_ENTRY('g', EXYNOS5420_GPIO_G00, EXYNOS5420_GPIO_J40, 0),
1518 GPIO_ENTRY('j', EXYNOS5420_GPIO_J40, EXYNOS5420_GPIO_Z0, 040),
1519 GPIO_ENTRY('z', EXYNOS5420_GPIO_Z0, EXYNOS5420_GPIO_MAX_PORT, 0),
1520 { 0 }
1521};
1522
1523void gpio_cfg_pin(int gpio, int cfg);
1524void gpio_set_pull(int gpio, int mode);
1525void gpio_set_drv(int gpio, int mode);
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1526void gpio_set_rate(int gpio, int mode);
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1527int s5p_gpio_get_pin(unsigned gpio);
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1528#endif
1529
1530/* Pin configurations */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1531#define S5P_GPIO_INPUT 0x0
1532#define S5P_GPIO_OUTPUT 0x1
1533#define S5P_GPIO_IRQ 0xf
1534#define S5P_GPIO_FUNC(x) (x)
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1535
1536/* Pull mode */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1537#define S5P_GPIO_PULL_NONE 0x0
1538#define S5P_GPIO_PULL_DOWN 0x1
1539#define S5P_GPIO_PULL_UP 0x3
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1540
1541/* Drive Strength level */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1542#define S5P_GPIO_DRV_1X 0x0
1543#define S5P_GPIO_DRV_3X 0x1
1544#define S5P_GPIO_DRV_2X 0x2
1545#define S5P_GPIO_DRV_4X 0x3
1546#define S5P_GPIO_DRV_FAST 0x0
1547#define S5P_GPIO_DRV_SLOW 0x1
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1548#endif