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blob: 9eeeb7699963b23f132d48a7d83f71c2674f8b4e [file] [log] [blame]
Tom Rini10e47792018-05-06 17:58:06 -0400[diff] [blame]1/* SPDX-License-Identifier: GPL-2.0+ */
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]2/*
3 * (C) Copyright 2010 Samsung Electronics
4 * Minkyu Kang <mk7.kang@samsung.com>
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6
7#ifndef __ASM_ARCH_GPIO_H
8#define __ASM_ARCH_GPIO_H
9
10#ifndef __ASSEMBLY__
Sam Protsenkoe7dff9d2023-10-20 16:46:32 -0500[diff] [blame]11
12#include <asm/arch/cpu.h>
13
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]14struct s5p_gpio_bank {
15 unsigned int con;
16 unsigned int dat;
17 unsigned int pull;
18 unsigned int drv;
19 unsigned int pdn_con;
20 unsigned int pdn_pull;
21 unsigned char res1[8];
22};
23
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]24/* GPIO pins per bank */
25#define GPIO_PER_BANK 8
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Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]27/* A list of valid GPIO numbers for the asm-generic/gpio.h interface */
28enum exynos4_gpio_pin {
29 /* GPIO_PART1_STARTS */
30 EXYNOS4_GPIO_A00, /* 0 */
31 EXYNOS4_GPIO_A01,
32 EXYNOS4_GPIO_A02,
33 EXYNOS4_GPIO_A03,
34 EXYNOS4_GPIO_A04,
35 EXYNOS4_GPIO_A05,
36 EXYNOS4_GPIO_A06,
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38 EXYNOS4_GPIO_A10, /* 8 */
39 EXYNOS4_GPIO_A11,
40 EXYNOS4_GPIO_A12,
41 EXYNOS4_GPIO_A13,
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45 EXYNOS4_GPIO_A17,
46 EXYNOS4_GPIO_B0, /* 16 0x10 */
47 EXYNOS4_GPIO_B1,
48 EXYNOS4_GPIO_B2,
49 EXYNOS4_GPIO_B3,
50 EXYNOS4_GPIO_B4,
51 EXYNOS4_GPIO_B5,
52 EXYNOS4_GPIO_B6,
53 EXYNOS4_GPIO_B7,
54 EXYNOS4_GPIO_C00, /* 24 0x18 */
55 EXYNOS4_GPIO_C01,
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58 EXYNOS4_GPIO_C04,
59 EXYNOS4_GPIO_C05,
60 EXYNOS4_GPIO_C06,
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62 EXYNOS4_GPIO_C10, /* 32 0x20*/
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70 EXYNOS4_GPIO_D00, /* 40 0x28 */
71 EXYNOS4_GPIO_D01,
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79 EXYNOS4_GPIO_D11,
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Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]158
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]159 /* GPIO_PART2_STARTS */
160 EXYNOS4_GPIO_MAX_PORT_PART_1, /* 128 0x80 */
161 EXYNOS4_GPIO_J00 = EXYNOS4_GPIO_MAX_PORT_PART_1,
162 EXYNOS4_GPIO_J01,
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194 EXYNOS4_GPIO_K21,
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201 EXYNOS4_GPIO_K30, /* 168 0xA8 */
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209 EXYNOS4_GPIO_L00, /* 176 0xB0 */
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282 EXYNOS4_GPIO_Y61,
283 EXYNOS4_GPIO_Y62,
284 EXYNOS4_GPIO_Y63,
285 EXYNOS4_GPIO_Y64,
286 EXYNOS4_GPIO_Y65,
287 EXYNOS4_GPIO_Y66,
288 EXYNOS4_GPIO_Y67,
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]289
290 /* GPIO_PART2_1 STARTS */
291 EXYNOS4_GPIO_MAX_PORT_PART_2_0, /* 256 0x100 */
292 EXYNOS4_GPIO_X00 = EXYNOS4_GPIO_MAX_PORT_PART_2_0,
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294 EXYNOS4_GPIO_X02,
295 EXYNOS4_GPIO_X03,
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298 EXYNOS4_GPIO_X06,
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302 EXYNOS4_GPIO_X12,
303 EXYNOS4_GPIO_X13,
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305 EXYNOS4_GPIO_X15,
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Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]308 EXYNOS4_GPIO_X20, /* 272 0x110 */
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310 EXYNOS4_GPIO_X22,
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Simon Glass9b4e0e82014-10-20 19:48:40 -0600[diff] [blame]316 EXYNOS4_GPIO_X30, /* 280 0x118 */
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323 EXYNOS4_GPIO_X37,
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]324
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Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]326 EXYNOS4_GPIO_MAX_PORT_PART_2_1, /* 288 0x120 */
327 EXYNOS4_GPIO_Z0 = EXYNOS4_GPIO_MAX_PORT_PART_2_1,
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]328 EXYNOS4_GPIO_Z1,
329 EXYNOS4_GPIO_Z2,
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Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]336 EXYNOS4_GPIO_MAX_PORT
Chander Kashyap252991e2012-12-25 20:13:42 +0000[diff] [blame]337};
338
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]339enum exynos4X12_gpio_pin {
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]340 /* EXYNOS4X12_GPIO_PART1_0 starts here */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]341 EXYNOS4X12_GPIO_A00, /* 0 */
342 EXYNOS4X12_GPIO_A01,
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382 EXYNOS4X12_GPIO_D01,
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1362 { EXYNOS4_GPIO_PART2_1, EXYNOS4_GPIO_MAX_PORT_PART_2_1 },
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1363 { EXYNOS4_GPIO_PART3_BASE, EXYNOS4_GPIO_MAX_PORT },
1364};
Chander Kashyap252991e2012-12-25 20:13:42 +0000[diff] [blame]1365
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]1366#define EXYNOS4X12_GPIO_NUM_PARTS 8
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1367static struct gpio_info exynos4x12_gpio_data[EXYNOS4X12_GPIO_NUM_PARTS] = {
Przemyslaw Marczakcce257f2014-10-28 17:31:06 +0100[diff] [blame]1368 { EXYNOS4X12_GPIO_PART1_0, EXYNOS4X12_GPIO_MAX_PORT_PART_1_0 },
1369 { EXYNOS4X12_GPIO_PART1_1, EXYNOS4X12_GPIO_MAX_PORT_PART_1_1 },
1370 { EXYNOS4X12_GPIO_PART1_2, EXYNOS4X12_GPIO_MAX_PORT_PART_1_2 },
1371 { EXYNOS4X12_GPIO_PART2_1, EXYNOS4X12_GPIO_MAX_PORT_PART_2_1 },
1372 { EXYNOS4X12_GPIO_PART2_2, EXYNOS4X12_GPIO_MAX_PORT_PART_2_2 },
1373 { EXYNOS4X12_GPIO_PART2_3, EXYNOS4X12_GPIO_MAX_PORT_PART_2_3 },
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1374 { EXYNOS4X12_GPIO_PART3_BASE, EXYNOS4X12_GPIO_MAX_PORT_PART_3 },
1375 { EXYNOS4X12_GPIO_PART4_BASE, EXYNOS4X12_GPIO_MAX_PORT },
1376};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1377
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1378#define EXYNOS5_GPIO_NUM_PARTS 8
1379static struct gpio_info exynos5_gpio_data[EXYNOS5_GPIO_NUM_PARTS] = {
1380 { EXYNOS5_GPIO_PART1_BASE, EXYNOS5_GPIO_MAX_PORT_PART_1 },
1381 { EXYNOS5_GPIO_PART2_BASE, EXYNOS5_GPIO_MAX_PORT_PART_2 },
1382 { EXYNOS5_GPIO_PART3_BASE, EXYNOS5_GPIO_MAX_PORT_PART_3 },
1383 { EXYNOS5_GPIO_PART4_BASE, EXYNOS5_GPIO_MAX_PORT_PART_4 },
1384 { EXYNOS5_GPIO_PART5_BASE, EXYNOS5_GPIO_MAX_PORT_PART_5 },
1385 { EXYNOS5_GPIO_PART6_BASE, EXYNOS5_GPIO_MAX_PORT_PART_6 },
1386 { EXYNOS5_GPIO_PART7_BASE, EXYNOS5_GPIO_MAX_PORT_PART_7 },
1387 { EXYNOS5_GPIO_PART8_BASE, EXYNOS5_GPIO_MAX_PORT },
1388};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1389
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1390#define EXYNOS5420_GPIO_NUM_PARTS 6
1391static struct gpio_info exynos5420_gpio_data[EXYNOS5420_GPIO_NUM_PARTS] = {
1392 { EXYNOS5420_GPIO_PART1_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_1 },
1393 { EXYNOS5420_GPIO_PART2_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_2 },
1394 { EXYNOS5420_GPIO_PART3_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_3 },
1395 { EXYNOS5420_GPIO_PART4_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_4 },
1396 { EXYNOS5420_GPIO_PART5_BASE, EXYNOS5420_GPIO_MAX_PORT_PART_5 },
1397 { EXYNOS5420_GPIO_PART6_BASE, EXYNOS5420_GPIO_MAX_PORT },
1398};
Chander Kashyap34076a02012-02-05 23:01:46 +0000[diff] [blame]1399
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1400static inline struct gpio_info *get_gpio_data(void)
Łukasz Majewski1e04cae2011-08-22 22:34:58 +0000[diff] [blame]1401{
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1402 if (cpu_is_exynos5()) {
Simon Glass8d451b42018-12-10 10:37:40 -0700[diff] [blame]1403 if (proid_is_exynos542x())
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1404 return exynos5420_gpio_data;
1405 else
1406 return exynos5_gpio_data;
1407 } else if (cpu_is_exynos4()) {
1408 if (proid_is_exynos4412())
1409 return exynos4x12_gpio_data;
1410 else
1411 return exynos4_gpio_data;
1412 }
Łukasz Majewski1e04cae2011-08-22 22:34:58 +0000[diff] [blame]1413
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1414 return NULL;
1415}
1416
1417static inline unsigned int get_bank_num(void)
1418{
1419 if (cpu_is_exynos5()) {
Simon Glass8d451b42018-12-10 10:37:40 -0700[diff] [blame]1420 if (proid_is_exynos542x())
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1421 return EXYNOS5420_GPIO_NUM_PARTS;
1422 else
1423 return EXYNOS5_GPIO_NUM_PARTS;
1424 } else if (cpu_is_exynos4()) {
1425 if (proid_is_exynos4412())
1426 return EXYNOS4X12_GPIO_NUM_PARTS;
1427 else
1428 return EXYNOS4_GPIO_NUM_PARTS;
Łukasz Majewskid6614b72012-09-04 21:47:46 +0000[diff] [blame]1429 }
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1430
1431 return 0;
Łukasz Majewskid6614b72012-09-04 21:47:46 +0000[diff] [blame]1432}
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1433
1434/*
1435 * This structure helps mapping symbolic GPIO names into indices from
1436 * exynos5_gpio_pin/exynos5420_gpio_pin enums.
1437 *
1438 * By convention, symbolic GPIO name is defined as follows:
1439 *
1440 * g[p]<bank><set><bit>, where
1441 * p is optional
1442 * <bank> - a single character bank name, as defined by the SOC
1443 * <set> - a single digit set number
1444 * <bit> - bit number within the set (in 0..7 range).
1445 *
1446 * <set><bit> essentially form an octal number of the GPIO pin within the bank
1447 * space. On the 5420 architecture some banks' sets do not start not from zero
1448 * ('d' starts from 1 and 'j' starts from 4). To compensate for that and
1449 * maintain flat number space withoout holes, those banks use offsets to be
1450 * deducted from the pin number.
1451 */
1452struct gpio_name_num_table {
1453 char bank; /* bank name symbol */
1454 unsigned int bank_size; /* total number of pins in the bank */
1455 char bank_offset; /* offset of the first bank's pin */
1456 unsigned int base; /* index of the first bank's pin in the enum */
1457};
1458
1459#define GPIO_ENTRY(name, base, top, offset) { name, top - base, offset, base }
1460static const struct gpio_name_num_table exynos4_gpio_table[] = {
1461 GPIO_ENTRY('a', EXYNOS4_GPIO_A00, EXYNOS4_GPIO_B0, 0),
1462 GPIO_ENTRY('b', EXYNOS4_GPIO_B0, EXYNOS4_GPIO_C00, 0),
1463 GPIO_ENTRY('c', EXYNOS4_GPIO_C00, EXYNOS4_GPIO_D00, 0),
1464 GPIO_ENTRY('d', EXYNOS4_GPIO_D00, EXYNOS4_GPIO_E00, 0),
1465 GPIO_ENTRY('e', EXYNOS4_GPIO_E00, EXYNOS4_GPIO_F00, 0),
1466 GPIO_ENTRY('f', EXYNOS4_GPIO_F00, EXYNOS4_GPIO_J00, 0),
1467 GPIO_ENTRY('j', EXYNOS4_GPIO_J00, EXYNOS4_GPIO_K00, 0),
1468 GPIO_ENTRY('k', EXYNOS4_GPIO_K00, EXYNOS4_GPIO_L00, 0),
1469 GPIO_ENTRY('l', EXYNOS4_GPIO_L00, EXYNOS4_GPIO_Y00, 0),
1470 GPIO_ENTRY('y', EXYNOS4_GPIO_Y00, EXYNOS4_GPIO_X00, 0),
1471 GPIO_ENTRY('x', EXYNOS4_GPIO_X00, EXYNOS4_GPIO_Z0, 0),
1472 GPIO_ENTRY('z', EXYNOS4_GPIO_Z0, EXYNOS4_GPIO_MAX_PORT, 0),
1473 { 0 }
1474};
1475
1476static const struct gpio_name_num_table exynos4x12_gpio_table[] = {
1477 GPIO_ENTRY('a', EXYNOS4X12_GPIO_A00, EXYNOS4X12_GPIO_B0, 0),
1478 GPIO_ENTRY('b', EXYNOS4X12_GPIO_B0, EXYNOS4X12_GPIO_C00, 0),
1479 GPIO_ENTRY('c', EXYNOS4X12_GPIO_C00, EXYNOS4X12_GPIO_D00, 0),
1480 GPIO_ENTRY('d', EXYNOS4X12_GPIO_D00, EXYNOS4X12_GPIO_F00, 0),
1481 GPIO_ENTRY('f', EXYNOS4X12_GPIO_F00, EXYNOS4X12_GPIO_J00, 0),
1482 GPIO_ENTRY('j', EXYNOS4X12_GPIO_J00, EXYNOS4X12_GPIO_K00, 0),
1483 GPIO_ENTRY('k', EXYNOS4X12_GPIO_K00, EXYNOS4X12_GPIO_L00, 0),
1484 GPIO_ENTRY('l', EXYNOS4X12_GPIO_L00, EXYNOS4X12_GPIO_Y00, 0),
1485 GPIO_ENTRY('y', EXYNOS4X12_GPIO_Y00, EXYNOS4X12_GPIO_M00, 0),
1486 GPIO_ENTRY('m', EXYNOS4X12_GPIO_M00, EXYNOS4X12_GPIO_X00, 0),
1487 GPIO_ENTRY('x', EXYNOS4X12_GPIO_X00, EXYNOS4X12_GPIO_Z0, 0),
1488 GPIO_ENTRY('z', EXYNOS4X12_GPIO_Z0, EXYNOS4X12_GPIO_V00, 0),
1489 GPIO_ENTRY('v', EXYNOS4X12_GPIO_V00, EXYNOS4X12_GPIO_MAX_PORT, 0),
1490 { 0 }
1491};
1492
1493static const struct gpio_name_num_table exynos5_gpio_table[] = {
1494 GPIO_ENTRY('a', EXYNOS5_GPIO_A00, EXYNOS5_GPIO_B00, 0),
1495 GPIO_ENTRY('b', EXYNOS5_GPIO_B00, EXYNOS5_GPIO_C00, 0),
1496 GPIO_ENTRY('c', EXYNOS5_GPIO_C00, EXYNOS5_GPIO_D00, 0),
1497 GPIO_ENTRY('d', EXYNOS5_GPIO_D00, EXYNOS5_GPIO_Y00, 0),
1498 GPIO_ENTRY('y', EXYNOS5_GPIO_Y00, EXYNOS5_GPIO_C40, 0),
1499 GPIO_ENTRY('x', EXYNOS5_GPIO_X00, EXYNOS5_GPIO_E00, 0),
1500 GPIO_ENTRY('e', EXYNOS5_GPIO_E00, EXYNOS5_GPIO_F00, 0),
1501 GPIO_ENTRY('f', EXYNOS5_GPIO_F00, EXYNOS5_GPIO_G00, 0),
1502 GPIO_ENTRY('g', EXYNOS5_GPIO_G00, EXYNOS5_GPIO_H00, 0),
1503 GPIO_ENTRY('h', EXYNOS5_GPIO_H00, EXYNOS5_GPIO_V00, 0),
1504 GPIO_ENTRY('v', EXYNOS5_GPIO_V00, EXYNOS5_GPIO_Z0, 0),
1505 GPIO_ENTRY('z', EXYNOS5_GPIO_Z0, EXYNOS5_GPIO_MAX_PORT, 0),
1506 { 0 }
1507};
1508
1509static const struct gpio_name_num_table exynos5420_gpio_table[] = {
1510 GPIO_ENTRY('a', EXYNOS5420_GPIO_A00, EXYNOS5420_GPIO_B00, 0),
1511 GPIO_ENTRY('b', EXYNOS5420_GPIO_B00, EXYNOS5420_GPIO_H00, 0),
1512 GPIO_ENTRY('h', EXYNOS5420_GPIO_H00, EXYNOS5420_GPIO_Y70, 0),
1513 GPIO_ENTRY('x', EXYNOS5420_GPIO_X00, EXYNOS5420_GPIO_C00, 0),
1514 GPIO_ENTRY('c', EXYNOS5420_GPIO_C00, EXYNOS5420_GPIO_D10, 0),
1515 GPIO_ENTRY('d', EXYNOS5420_GPIO_D10, EXYNOS5420_GPIO_Y00, 010),
1516 GPIO_ENTRY('y', EXYNOS5420_GPIO_Y00, EXYNOS5420_GPIO_E00, 0),
1517 GPIO_ENTRY('e', EXYNOS5420_GPIO_E00, EXYNOS5420_GPIO_F00, 0),
1518 GPIO_ENTRY('f', EXYNOS5420_GPIO_F00, EXYNOS5420_GPIO_G00, 0),
1519 GPIO_ENTRY('g', EXYNOS5420_GPIO_G00, EXYNOS5420_GPIO_J40, 0),
1520 GPIO_ENTRY('j', EXYNOS5420_GPIO_J40, EXYNOS5420_GPIO_Z0, 040),
1521 GPIO_ENTRY('z', EXYNOS5420_GPIO_Z0, EXYNOS5420_GPIO_MAX_PORT, 0),
1522 { 0 }
1523};
1524
1525void gpio_cfg_pin(int gpio, int cfg);
1526void gpio_set_pull(int gpio, int mode);
1527void gpio_set_drv(int gpio, int mode);
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1528void gpio_set_rate(int gpio, int mode);
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1529int s5p_gpio_get_pin(unsigned gpio);
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1530#endif
1531
1532/* Pin configurations */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1533#define S5P_GPIO_INPUT 0x0
1534#define S5P_GPIO_OUTPUT 0x1
1535#define S5P_GPIO_IRQ 0xf
1536#define S5P_GPIO_FUNC(x) (x)
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1537
1538/* Pull mode */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1539#define S5P_GPIO_PULL_NONE 0x0
1540#define S5P_GPIO_PULL_DOWN 0x1
1541#define S5P_GPIO_PULL_UP 0x3
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1542
1543/* Drive Strength level */
Akshay Saraswat1376cdd2014-05-13 10:30:14 +0530[diff] [blame]1544#define S5P_GPIO_DRV_1X 0x0
1545#define S5P_GPIO_DRV_3X 0x1
1546#define S5P_GPIO_DRV_2X 0x2
1547#define S5P_GPIO_DRV_4X 0x3
1548#define S5P_GPIO_DRV_FAST 0x0
1549#define S5P_GPIO_DRV_SLOW 0x1
Minkyu Kangb1b24682011-01-24 15:22:23 +0900[diff] [blame]1550#endif