Blame - board/overo/overo.h - filogic/uboot

blob: b41b628899eebb0d98c9ea91b11cf8c5cce2648d [file] [log] [blame]

Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	1	/*
				2	* (C) Copyright 2008
				3	* Steve Sakoman <steve@sakoman.com>
				4	*
				5	* See file CREDITS for list of people who contributed to this
				6	* project.
				7	*
				8	* This program is free software; you can redistribute it and/or
				9	* modify it under the terms of the GNU General Public License as
				10	* published by the Free Software Foundation; either version 2 of
				11	* the License, or (at your option) any later version.
				12	*
				13	* This program is distributed in the hope that it will be useful,
				14	* but WITHOUT ANY WARRANTY; without even the implied warranty of
				15	* MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
				16	* GNU General Public License for more details.
				17	*
				18	* You should have received a copy of the GNU General Public License
				19	* along with this program; if not, write to the Free Software
				20	* Foundation, Inc., 59 Temple Place, Suite 330, Boston,
				21	* MA 02111-1307 USA
				22	*/
				23	#ifndef _OVERO_H_
				24	#define _OVERO_H_
				25
				26	const omap3_sysinfo sysinfo = {
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	27	DDR_STACKED,
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	28	"Gumstix Overo board",
				29	#if defined(CONFIG_ENV_IS_IN_ONENAND)
				30	"OneNAND",
				31	#else
				32	"NAND",
				33	#endif
				34	};
				35
Andreas Müller	785f1f0	2012-01-04 15:26:25 +0000	[diff] [blame]	36	/* overo revisions */
				37	#define REVISION_0 0x0
				38	#define REVISION_1 0x1
				39	#define REVISION_2 0x2
				40
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	41	/*
				42	* IEN - Input Enable
				43	* IDIS - Input Disable
				44	* PTD - Pull type Down
				45	* PTU - Pull type Up
				46	* DIS - Pull type selection is inactive
				47	* EN - Pull type selection is active
				48	* M0 - Mode 0
				49	* The commented string gives the final mux configuration for that pin
				50	*/
				51	#define MUX_OVERO() \
				52	/SDRC/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	53	MUX_VAL(CP(SDRC_D0), (IEN \| PTD \| DIS \| M0)) /SDRC_D0/\
				54	MUX_VAL(CP(SDRC_D1), (IEN \| PTD \| DIS \| M0)) /SDRC_D1/\
				55	MUX_VAL(CP(SDRC_D2), (IEN \| PTD \| DIS \| M0)) /SDRC_D2/\
				56	MUX_VAL(CP(SDRC_D3), (IEN \| PTD \| DIS \| M0)) /SDRC_D3/\
				57	MUX_VAL(CP(SDRC_D4), (IEN \| PTD \| DIS \| M0)) /SDRC_D4/\
				58	MUX_VAL(CP(SDRC_D5), (IEN \| PTD \| DIS \| M0)) /SDRC_D5/\
				59	MUX_VAL(CP(SDRC_D6), (IEN \| PTD \| DIS \| M0)) /SDRC_D6/\
				60	MUX_VAL(CP(SDRC_D7), (IEN \| PTD \| DIS \| M0)) /SDRC_D7/\
				61	MUX_VAL(CP(SDRC_D8), (IEN \| PTD \| DIS \| M0)) /SDRC_D8/\
				62	MUX_VAL(CP(SDRC_D9), (IEN \| PTD \| DIS \| M0)) /SDRC_D9/\
				63	MUX_VAL(CP(SDRC_D10), (IEN \| PTD \| DIS \| M0)) /SDRC_D10/\
				64	MUX_VAL(CP(SDRC_D11), (IEN \| PTD \| DIS \| M0)) /SDRC_D11/\
				65	MUX_VAL(CP(SDRC_D12), (IEN \| PTD \| DIS \| M0)) /SDRC_D12/\
				66	MUX_VAL(CP(SDRC_D13), (IEN \| PTD \| DIS \| M0)) /SDRC_D13/\
				67	MUX_VAL(CP(SDRC_D14), (IEN \| PTD \| DIS \| M0)) /SDRC_D14/\
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				69	MUX_VAL(CP(SDRC_D16), (IEN \| PTD \| DIS \| M0)) /SDRC_D16/\
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				87	MUX_VAL(CP(SDRC_DQS1), (IEN \| PTD \| DIS \| M0)) /SDRC_DQS1/\
				88	MUX_VAL(CP(SDRC_DQS2), (IEN \| PTD \| DIS \| M0)) /SDRC_DQS2/\
				89	MUX_VAL(CP(SDRC_DQS3), (IEN \| PTD \| DIS \| M0)) /SDRC_DQS3/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	90	/GPMC/\
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				93	MUX_VAL(CP(GPMC_A3), (IDIS \| PTU \| EN \| M0)) /GPMC_A3/\
				94	MUX_VAL(CP(GPMC_A4), (IDIS \| PTU \| EN \| M0)) /GPMC_A4/\
				95	MUX_VAL(CP(GPMC_A5), (IDIS \| PTU \| EN \| M0)) /GPMC_A5/\
				96	MUX_VAL(CP(GPMC_A6), (IDIS \| PTU \| EN \| M0)) /GPMC_A6/\
				97	MUX_VAL(CP(GPMC_A7), (IDIS \| PTU \| EN \| M0)) /GPMC_A7/\
				98	MUX_VAL(CP(GPMC_A8), (IDIS \| PTU \| EN \| M0)) /GPMC_A8/\
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				101	MUX_VAL(CP(GPMC_D0), (IEN \| PTU \| EN \| M0)) /GPMC_D0/\
				102	MUX_VAL(CP(GPMC_D1), (IEN \| PTU \| EN \| M0)) /GPMC_D1/\
				103	MUX_VAL(CP(GPMC_D2), (IEN \| PTU \| EN \| M0)) /GPMC_D2/\
				104	MUX_VAL(CP(GPMC_D3), (IEN \| PTU \| EN \| M0)) /GPMC_D3/\
				105	MUX_VAL(CP(GPMC_D4), (IEN \| PTU \| EN \| M0)) /GPMC_D4/\
				106	MUX_VAL(CP(GPMC_D5), (IEN \| PTU \| EN \| M0)) /GPMC_D5/\
				107	MUX_VAL(CP(GPMC_D6), (IEN \| PTU \| EN \| M0)) /GPMC_D6/\
				108	MUX_VAL(CP(GPMC_D7), (IEN \| PTU \| EN \| M0)) /GPMC_D7/\
				109	MUX_VAL(CP(GPMC_D8), (IEN \| PTU \| EN \| M0)) /GPMC_D8/\
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				115	MUX_VAL(CP(GPMC_D14), (IEN \| PTU \| EN \| M0)) /GPMC_D14/\
				116	MUX_VAL(CP(GPMC_D15), (IEN \| PTU \| EN \| M0)) /GPMC_D15/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	117	MUX_VAL(CP(GPMC_NCS0), (IDIS \| PTU \| EN \| M0)) /GPMC_nCS0/\
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				119	MUX_VAL(CP(GPMC_NCS2), (IDIS \| PTU \| EN \| M0)) /GPMC_nCS2/\
				120	MUX_VAL(CP(GPMC_NCS3), (IEN \| PTU \| EN \| M4)) /GPIO_54/\
				121	/* - MMC1_WP*/\
				122	MUX_VAL(CP(GPMC_NCS4), (IDIS \| PTU \| EN \| M0)) /GPMC_nCS4/\
Olof Johansson	4963f92	2009-09-29 10:22:45 -0400	[diff] [blame]	123	MUX_VAL(CP(GPMC_NCS5), (IDIS \| PTU \| EN \| M0)) /GPMC_nCS5/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	124	MUX_VAL(CP(GPMC_NCS6), (IEN \| PTD \| DIS \| M0)) /GPMC_nCS6/\
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				126	MUX_VAL(CP(GPMC_NBE1), (IEN \| PTD \| DIS \| M0)) /GPMC_nCS3/\
Philip Balister	d202473	2011-09-14 12:50:12 -0400	[diff] [blame]	127	MUX_VAL(CP(GPMC_CLK), (IEN \| PTU \| EN \| M0)) /GPMC_CLK/\
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				134	MUX_VAL(CP(GPMC_WAIT1), (IEN \| PTU \| EN \| M0)) /GPMC_WAIT1/\
Olof Johansson	4963f92	2009-09-29 10:22:45 -0400	[diff] [blame]	135	MUX_VAL(CP(GPMC_WAIT2), (IEN \| PTU \| EN \| M4)) /GPIO_64/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	136	/* - SMSC911X_NRES*/\
Steve Sakoman	0d1d008	2010-08-12 21:07:02 -0700	[diff] [blame]	137	MUX_VAL(CP(GPMC_WAIT3), (IEN \| PTU \| DIS \| M4)) /GPIO_65/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	138	/DSS/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	139	MUX_VAL(CP(DSS_PCLK), (IDIS \| PTD \| DIS \| M0)) /DSS_PCLK/\
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Steve Sakoman	2498ad3	2011-09-30 09:08:36 +0000	[diff] [blame]	171	MUX_VAL(CP(CAM_PCLK), (IEN \| PTU \| DIS \| M0)) /CAM_PCLK/\
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				191	/* - PEN_DOWN*/\
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Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	209	/Wireless LAN /\
Steve Sakoman	541ce99	2010-08-24 10:37:29 -0700	[diff] [blame]	210	MUX_VAL(CP(MMC2_CLK), (IEN \| PTU \| EN \| M4)) /GPIO_130/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	211	MUX_VAL(CP(MMC2_CMD), (IEN \| PTU \| EN \| M0)) /MMC2_CMD/\
				212	MUX_VAL(CP(MMC2_DAT0), (IEN \| PTU \| EN \| M0)) /MMC2_DAT0/\
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				214	MUX_VAL(CP(MMC2_DAT2), (IEN \| PTU \| EN \| M0)) /MMC2_DAT2/\
				215	MUX_VAL(CP(MMC2_DAT3), (IEN \| PTU \| EN \| M0)) /MMC2_DAT3/\
				216	MUX_VAL(CP(MMC2_DAT4), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT0/\
				217	MUX_VAL(CP(MMC2_DAT5), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT1/\
				218	MUX_VAL(CP(MMC2_DAT6), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_CMD/\
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				225	MUX_VAL(CP(UART2_CTS), (IEN \| PTD \| DIS \| M4)) /GPIO_144 - LCD_EN/\
				226	MUX_VAL(CP(UART2_RTS), (IEN \| PTD \| DIS \| M4)) /GPIO_145/\
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				228	MUX_VAL(CP(UART2_RX), (IEN \| PTD \| DIS \| M4)) /GPIO_147/\
				229	MUX_VAL(CP(UART1_TX), (IDIS \| PTD \| DIS \| M0)) /UART1_TX/\
				230	MUX_VAL(CP(UART1_RTS), (IEN \| PTU \| DIS \| M4)) /GPIO_149/ \
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				232	MUX_VAL(CP(UART1_RX), (IEN \| PTD \| DIS \| M0)) /UART1_RX/\
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				234	MUX_VAL(CP(MCBSP4_DR), (IEN \| PTD \| DIS \| M0)) /McBSP4_DR/\
				235	MUX_VAL(CP(MCBSP4_DX), (IEN \| PTD \| DIS \| M0)) /McBSP4_DX/\
				236	MUX_VAL(CP(MCBSP4_FSX), (IEN \| PTD \| DIS \| M0)) /McBSP4_FSX/\
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				238	MUX_VAL(CP(MCBSP1_FSR), (IEN \| PTD \| DIS \| M0)) /McBSP1_FSR/\
				239	MUX_VAL(CP(MCBSP1_DX), (IEN \| PTD \| DIS \| M0)) /McBSP1_DX/\
				240	MUX_VAL(CP(MCBSP1_DR), (IEN \| PTD \| DIS \| M0)) /McBSP1_DR/\
				241	MUX_VAL(CP(MCBSP_CLKS), (IEN \| PTU \| DIS \| M0)) /McBSP_CLKS/\
				242	MUX_VAL(CP(MCBSP1_FSX), (IEN \| PTD \| DIS \| M0)) /McBSP1_FSX/\
				243	MUX_VAL(CP(MCBSP1_CLKX), (IEN \| PTD \| DIS \| M0)) /McBSP1_CLKX/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	244	/Serial Interface/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	245	MUX_VAL(CP(UART3_CTS_RCTX), (IEN \| PTD \| EN \| M0)) /UART3_CTS_RCTX/\
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				247	/* BT_NRESET*/\
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Olof Johansson	4963f92	2009-09-29 10:22:45 -0400	[diff] [blame]	278	MUX_VAL(CP(MCSPI1_CS2), (IEN \| PTU \| DIS \| M4)) /GPIO_176 /\
				279	/* - LAN_INTR */\
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Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	286	/Control and debug /\
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Steve Sakoman	9aff406	2011-09-30 09:04:14 +0000	[diff] [blame]	298	MUX_VAL(CP(SYS_CLKOUT1), (IEN \| PTU \| EN \| M4)) /GPIO_10/\
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Steve Sakoman	3a00c66	2010-02-16 10:00:45 -0800	[diff] [blame]	300	MUX_VAL(CP(ETK_CLK_ES2), (IEN \| PTU \| EN \| M2)) /MMC3_CLK/\
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Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	319	/* die to die */\
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Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	385
Steve Sakoman	541ce99	2010-08-24 10:37:29 -0700	[diff] [blame]	386	#define MUX_OVERO_SDIO2_DIRECT() \
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				391	MUX_VAL(CP(MMC2_DAT2), (IEN \| PTU \| EN \| M0)) /MMC2_DAT2/\
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				400	MUX_VAL(CP(MMC1_DAT7), (IEN \| PTU \| EN \| M4)) /GPIO_129/
				401
				402	#define MUX_OVERO_SDIO2_TRANSCEIVER() \
				403	MUX_VAL(CP(MMC2_CLK), (IEN \| PTU \| EN \| M0)) /MMC2_CLK/\
				404	MUX_VAL(CP(MMC2_CMD), (IEN \| PTU \| EN \| M0)) /MMC2_CMD/\
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				406	MUX_VAL(CP(MMC2_DAT1), (IEN \| PTU \| EN \| M0)) /MMC2_DAT1/\
				407	MUX_VAL(CP(MMC2_DAT2), (IEN \| PTU \| EN \| M0)) /MMC2_DAT2/\
				408	MUX_VAL(CP(MMC2_DAT3), (IEN \| PTU \| EN \| M0)) /MMC2_DAT3/\
				409	MUX_VAL(CP(MMC2_DAT4), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT0/\
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				421
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