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git01.mediatek.com / filogic / uboot / d79de1d950d4779583a97be8eaab135d2bca3565 / . / arch / m68k / include / asm / immap_5441x.h
blob: 4db6145fca8ae02458cd0b31eea0a0dda3e61827 [file] [log] [blame]
Alison Wangfdc2fb12012-10-18 19:25:51 +0000[diff] [blame]1/*
2 * MCF5441x Internal Memory Map
3 *
4 * Copyright 2010-2012 Freescale Semiconductor, Inc.
5 * TsiChung Liew (Tsi-Chung.Liew@freescale.com)
6 *
Wolfgang Denkd79de1d2013-07-08 09:37:19 +0200[diff] [blame^]7 * SPDX-License-Identifier: GPL-2.0+
Alison Wangfdc2fb12012-10-18 19:25:51 +0000[diff] [blame]8 */
9
10#ifndef __IMMAP_5441X__
11#define __IMMAP_5441X__
12
13/* Module Base Addresses */
14#define MMAP_XBS 0xFC004000
15#define MMAP_FBCS 0xFC008000
16#define MMAP_CAN0 0xFC020000
17#define MMAP_CAN1 0xFC024000
18#define MMAP_I2C1 0xFC038000
19#define MMAP_DSPI1 0xFC03C000
20#define MMAP_SCM 0xFC040000
21#define MMAP_PM 0xFC04002C
22#define MMAP_EDMA 0xFC044000
23#define MMAP_INTC0 0xFC048000
24#define MMAP_INTC1 0xFC04C000
25#define MMAP_INTC2 0xFC050000
26#define MMAP_IACK 0xFC054000
27#define MMAP_I2C0 0xFC058000
28#define MMAP_DSPI0 0xFC05C000
29#define MMAP_UART0 0xFC060000
30#define MMAP_UART1 0xFC064000
31#define MMAP_UART2 0xFC068000
32#define MMAP_UART3 0xFC06C000
33#define MMAP_DTMR0 0xFC070000
34#define MMAP_DTMR1 0xFC074000
35#define MMAP_DTMR2 0xFC078000
36#define MMAP_DTMR3 0xFC07C000
37#define MMAP_PIT0 0xFC080000
38#define MMAP_PIT1 0xFC084000
39#define MMAP_PIT2 0xFC088000
40#define MMAP_PIT3 0xFC08C000
41#define MMAP_EPORT0 0xFC090000
42#define MMAP_ADC 0xFC094000
43#define MMAP_DAC0 0xFC098000
44#define MMAP_DAC1 0xFC09C000
45#define MMAP_RRTC 0xFC0A8000
46#define MMAP_SIM 0xFC0AC000
47#define MMAP_USBOTG 0xFC0B0000
48#define MMAP_USBEHCI 0xFC0B4000
49#define MMAP_SDRAM 0xFC0B8000
50#define MMAP_SSI0 0xFC0BC000
51#define MMAP_PLL 0xFC0C0000
52#define MMAP_RNG 0xFC0C4000
53#define MMAP_SSI1 0xFC0C8000
54#define MMAP_ESDHC 0xFC0CC000
55#define MMAP_FEC0 0xFC0D4000
56#define MMAP_FEC1 0xFC0D8000
57#define MMAP_L2_SW0 0xFC0DC000
58#define MMAP_L2_SW1 0xFC0E0000
59
60#define MMAP_NFC_RAM 0xFC0FC000
61#define MMAP_NFC 0xFC0FF000
62
63#define MMAP_1WIRE 0xEC008000
64#define MMAP_I2C2 0xEC010000
65#define MMAP_I2C3 0xEC014000
66#define MMAP_I2C4 0xEC018000
67#define MMAP_I2C5 0xEC01C000
68#define MMAP_DSPI2 0xEC038000
69#define MMAP_DSPI3 0xEC03C000
70#define MMAP_UART4 0xEC060000
71#define MMAP_UART5 0xEC064000
72#define MMAP_UART6 0xEC068000
73#define MMAP_UART7 0xEC06C000
74#define MMAP_UART8 0xEC070000
75#define MMAP_UART9 0xEC074000
76#define MMAP_RCM 0xEC090000
77#define MMAP_CCM 0xEC090000
78#define MMAP_GPIO 0xEC094000
79
80#include <asm/coldfire/crossbar.h>
81#include <asm/coldfire/dspi.h>
82#include <asm/coldfire/edma.h>
83#include <asm/coldfire/eport.h>
84#include <asm/coldfire/flexbus.h>
85#include <asm/coldfire/flexcan.h>
86#include <asm/coldfire/intctrl.h>
87#include <asm/coldfire/ssi.h>
88
89/* Serial Boot Facility (SBF) */
90typedef struct sbf {
91 u8 resv0[0x18];
92 u16 sbfsr; /* Serial Boot Facility Status */
93 u8 resv1[0x6];
94 u16 sbfcr; /* Serial Boot Facility Control */
95} sbf_t;
96
97/* Reset Controller Module (RCM) */
98typedef struct rcm {
99 u8 rcr;
100 u8 rsr;
101} rcm_t;
102
103/* Chip Configuration Module (CCM) */
104typedef struct ccm {
105 u8 ccm_resv0[0x4]; /* 0x00 */
106 u16 ccr; /* 0x04 Chip Configuration */
107 u8 resv1[0x2]; /* 0x06 */
108 u16 rcon; /* 0x08 Reset Configuration */
109 u16 cir; /* 0x0A Chip Identification */
110 u8 resv2[0x2]; /* 0x0C */
111 u16 misccr; /* 0x0E Miscellaneous Control */
112 u16 cdrh; /* 0x10 Clock Divider */
113 u16 cdrl; /* 0x12 Clock Divider */
114 u16 uocsr; /* 0x14 USB On-the-Go Controller Status */
115 u16 uhcsr; /* 0x16 */
116 u16 misccr3; /* 0x18 */
117 u16 misccr2; /* 0x1A */
118 u16 adctsr; /* 0x1C */
119 u16 dactsr; /* 0x1E */
120 u16 sbfsr; /* 0x20 */
121 u16 sbfcr; /* 0x22 */
122 u32 fnacr; /* 0x24 */
123} ccm_t;
124
125/* General Purpose I/O Module (GPIO) */
126typedef struct gpio {
127 u8 podr_a; /* 0x00 */
128 u8 podr_b; /* 0x01 */
129 u8 podr_c; /* 0x02 */
130 u8 podr_d; /* 0x03 */
131 u8 podr_e; /* 0x04 */
132 u8 podr_f; /* 0x05 */
133 u8 podr_g; /* 0x06 */
134 u8 podr_h; /* 0x07 */
135 u8 podr_i; /* 0x08 */
136 u8 podr_j; /* 0x09 */
137 u8 podr_k; /* 0x0A */
138 u8 rsvd0; /* 0x0B */
139
140 u8 pddr_a; /* 0x0C */
141 u8 pddr_b; /* 0x0D */
142 u8 pddr_c; /* 0x0E */
143 u8 pddr_d; /* 0x0F */
144 u8 pddr_e; /* 0x10 */
145 u8 pddr_f; /* 0x11 */
146 u8 pddr_g; /* 0x12 */
147 u8 pddr_h; /* 0x13 */
148 u8 pddr_i; /* 0x14 */
149 u8 pddr_j; /* 0x15 */
150 u8 pddr_k; /* 0x16 */
151 u8 rsvd1; /* 0x17 */
152
153 u8 ppdsdr_a; /* 0x18 */
154 u8 ppdsdr_b; /* 0x19 */
155 u8 ppdsdr_c; /* 0x1A */
156 u8 ppdsdr_d; /* 0x1B */
157 u8 ppdsdr_e; /* 0x1C */
158 u8 ppdsdr_f; /* 0x1D */
159 u8 ppdsdr_g; /* 0x1E */
160 u8 ppdsdr_h; /* 0x1F */
161 u8 ppdsdr_i; /* 0x20 */
162 u8 ppdsdr_j; /* 0x21 */
163 u8 ppdsdr_k; /* 0x22 */
164 u8 rsvd2; /* 0x23 */
165
166 u8 pclrr_a; /* 0x24 */
167 u8 pclrr_b; /* 0x25 */
168 u8 pclrr_c; /* 0x26 */
169 u8 pclrr_d; /* 0x27 */
170 u8 pclrr_e; /* 0x28 */
171 u8 pclrr_f; /* 0x29 */
172 u8 pclrr_g; /* 0x2A */
173 u8 pclrr_h; /* 0x2B */
174 u8 pclrr_i; /* 0x2C */
175 u8 pclrr_j; /* 0x2D */
176 u8 pclrr_k; /* 0x2E */
177 u8 rsvd3; /* 0x2F */
178
179 u16 pcr_a; /* 0x30 */
180 u16 pcr_b; /* 0x32 */
181 u16 pcr_c; /* 0x34 */
182 u16 pcr_d; /* 0x36 */
183 u16 pcr_e; /* 0x38 */
184 u16 pcr_f; /* 0x3A */
185 u16 pcr_g; /* 0x3C */
186 u16 pcr_h; /* 0x3E */
187 u16 pcr_i; /* 0x40 */
188 u16 pcr_j; /* 0x42 */
189 u16 pcr_k; /* 0x44 */
190 u16 rsvd4; /* 0x46 */
191
192 u8 par_fbctl; /* 0x48 */
193 u8 par_be; /* 0x49 */
194 u8 par_cs; /* 0x4A */
195 u8 par_cani2c; /* 0x4B */
196 u8 par_irqh; /* 0x4C */
197 u8 par_irql; /* 0x4D */
198 u8 par_dspi0; /* 0x4E */
199 u8 par_dspiow; /* 0x4F */
200 u8 par_timer; /* 0x50 */
201 u8 par_uart2; /* 0x51 */
202 u8 par_uart1; /* 0x52 */
203 u8 par_uart0; /* 0x53 */
204 u8 par_sdhch; /* 0x54 */
205 u8 par_sdhcl; /* 0x55 */
206 u8 par_simp0h; /* 0x56 */
207 u8 par_simp1h; /* 0x57 */
208 u8 par_ssi0h; /* 0x58 */
209 u8 par_ssi0l; /* 0x59 */
210 u8 par_dbg1h; /* 0x5A */
211 u8 par_dbg0h; /* 0x5B */
212 u8 par_dbgl; /* 0x5C */
213 u8 rsvd5; /* 0x5D */
214 u8 par_fec; /* 0x5E */
215 u8 rsvd6; /* 0x5F */
216
217 u8 mscr_sdram; /* 0x60 */
218 u8 rsvd7[3]; /* 0x61-0x63 */
219
220 u8 srcr_fb1; /* 0x64 */
221 u8 srcr_fb2; /* 0x65 */
222 u8 srcr_fb3; /* 0x66 */
223 u8 srcr_fb4; /* 0x67 */
224 u8 srcr_dspiow; /* 0x68 */
225 u8 srcr_cani2c; /* 0x69 */
226 u8 srcr_irq; /* 0x6A */
227 u8 srcr_timer; /* 0x6B */
228 u8 srcr_uart; /* 0x6C */
229 u8 srcr_fec; /* 0x6D */
230 u8 srcr_sdhc; /* 0x6E */
231 u8 srcr_simp0; /* 0x6F */
232 u8 srcr_ssi0; /* 0x70 */
233 u8 rsvd8[3]; /* 0x71-0x73 */
234
235 u16 urts_pol; /* 0x74 */
236 u16 ucts_pol; /* 0x76 */
237 u16 utxd_wom; /* 0x78 */
238 u32 urxd_wom; /* 0x7c */
239
240 u32 hcr1; /* 0x80 */
241 u32 hcr0; /* 0x84 */
242} gpio_t;
243
244/* SDRAM Controller (SDRAMC) */
245typedef struct sdramc {
246 u32 cr00; /* 0x00 */
247 u32 cr01; /* 0x04 */
248 u32 cr02; /* 0x08 */
249 u32 cr03; /* 0x0C */
250 u32 cr04; /* 0x10 */
251 u32 cr05; /* 0x14 */
252 u32 cr06; /* 0x18 */
253 u32 cr07; /* 0x1C */
254
255 u32 cr08; /* 0x20 */
256 u32 cr09; /* 0x24 */
257 u32 cr10; /* 0x28 */
258 u32 cr11; /* 0x2C */
259 u32 cr12; /* 0x30 */
260 u32 cr13; /* 0x34 */
261 u32 cr14; /* 0x38 */
262 u32 cr15; /* 0x3C */
263
264 u32 cr16; /* 0x40 */
265 u32 cr17; /* 0x44 */
266 u32 cr18; /* 0x48 */
267 u32 cr19; /* 0x4C */
268 u32 cr20; /* 0x50 */
269 u32 cr21; /* 0x54 */
270 u32 cr22; /* 0x58 */
271 u32 cr23; /* 0x5C */
272
273 u32 cr24; /* 0x60 */
274 u32 cr25; /* 0x64 */
275 u32 cr26; /* 0x68 */
276 u32 cr27; /* 0x6C */
277 u32 cr28; /* 0x70 */
278 u32 cr29; /* 0x74 */
279 u32 cr30; /* 0x78 */
280 u32 cr31; /* 0x7C */
281
282 u32 cr32; /* 0x80 */
283 u32 cr33; /* 0x84 */
284 u32 cr34; /* 0x88 */
285 u32 cr35; /* 0x8C */
286 u32 cr36; /* 0x90 */
287 u32 cr37; /* 0x94 */
288 u32 cr38; /* 0x98 */
289 u32 cr39; /* 0x9C */
290
291 u32 cr40; /* 0xA0 */
292 u32 cr41; /* 0xA4 */
293 u32 cr42; /* 0xA8 */
294 u32 cr43; /* 0xAC */
295 u32 cr44; /* 0xB0 */
296 u32 cr45; /* 0xB4 */
297 u32 cr46; /* 0xB8 */
298 u32 cr47; /* 0xBC */
299 u32 cr48; /* 0xC0 */
300 u32 cr49; /* 0xC4 */
301 u32 cr50; /* 0xC8 */
302 u32 cr51; /* 0xCC */
303 u32 cr52; /* 0xD0 */
304 u32 cr53; /* 0xD4 */
305 u32 cr54; /* 0xD8 */
306 u32 cr55; /* 0xDC */
307 u32 cr56; /* 0xE0 */
308 u32 cr57; /* 0xE4 */
309 u32 cr58; /* 0xE8 */
310 u32 cr59; /* 0xEC */
311 u32 cr60; /* 0xF0 */
312 u32 cr61; /* 0xF4 */
313 u32 cr62; /* 0xF8 */
314 u32 cr63; /* 0xFC */
315
316 u32 rsvd3[32]; /* 0xF4-0x1A8 */
317
318 u32 rcrcr; /* 0x180 */
319 u32 swrcr; /* 0x184 */
320 u32 rcr; /* 0x188 */
321 u32 msovr; /* 0x18C */
322 u32 rcrdbg; /* 0x190 */
323 u32 sl0adj; /* 0x194 */
324 u32 sl1adj; /* 0x198 */
325 u32 sl2adj; /* 0x19C */
326 u32 sl3adj; /* 0x1A0 */
327 u32 sl4adj; /* 0x1A4 */
328 u32 flight_tm; /* 0x1A8 */
329 u32 padcr; /* 0x1AC */
330} sdramc_t;
331
332/* Phase Locked Loop (PLL) */
333typedef struct pll {
334 u32 pcr; /* Control */
335 u32 pdr; /* Divider */
336 u32 psr; /* Status */
337} pll_t;
338
339typedef struct scm {
340 u8 rsvd1[19]; /* 0x00 - 0x12 */
341 u8 wcr; /* 0x13 */
342 u16 rsvd2; /* 0x14 - 0x15 */
343 u16 cwcr; /* 0x16 */
344 u8 rsvd3[3]; /* 0x18 - 0x1A */
345 u8 cwsr; /* 0x1B */
346 u8 rsvd4[3]; /* 0x1C - 0x1E */
347 u8 scmisr; /* 0x1F */
348 u32 rsvd5; /* 0x20 - 0x23 */
349 u32 bcr; /* 0x24 */
350 u8 rsvd6[72]; /* 0x28 - 0x6F */
351 u32 cfadr; /* 0x70 */
352 u8 rsvd7; /* 0x74 */
353 u8 cfier; /* 0x75 */
354 u8 cfloc; /* 0x76 */
355 u8 cfatr; /* 0x77 */
356 u32 rsvd8; /* 0x78 - 0x7B */
357 u32 cfdtr; /* 0x7C */
358} scm_t;
359
360typedef struct pm {
361 u8 pmsr0; /* */
362 u8 pmcr0;
363 u8 pmsr1;
364 u8 pmcr1;
365 u32 pmhr0;
366 u32 pmlr0;
367 u32 pmhr1;
368 u32 pmlr1;
369} pm_t;
370
371#endif /* __IMMAP_5441X__ */