blob: 7e7a18484fdf316e2b5f9c4282e73702f7fa6c9d [file] [log] [blame]
Chin Liang See967b4df2013-09-11 11:26:10 -05001/* This file is generated by Preloader Generator */
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4
Marek Vasut69295472014-12-30 18:16:08 +01005#ifdef CONFIG_TARGET_SOCFPGA_CYCLONE5
Chin Liang See967b4df2013-09-11 11:26:10 -05006/* pin mux configuration data */
7unsigned long sys_mgr_init_table[CONFIG_HPS_PINMUX_NUM] = {
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214 0 /* SPIM0USEFPGA */
215};
Marek Vasut69295472014-12-30 18:16:08 +0100216#endif /* CONFIG_TARGET_SOCFPGA_CYCLONE5 */
217
218#ifdef CONFIG_TARGET_SOCFPGA_ARRIA5
219/* pin mux configuration data */
220unsigned long sys_mgr_init_table[CONFIG_HPS_PINMUX_NUM] = {
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391 1, /* GPLMUX53 */
392 1, /* GPLMUX54 */
393 1, /* GPLMUX55 */
394 1, /* GPLMUX56 */
395 1, /* GPLMUX57 */
396 1, /* GPLMUX58 */
397 1, /* GPLMUX59 */
398 1, /* GPLMUX60 */
399 1, /* GPLMUX61 */
400 1, /* GPLMUX62 */
401 1, /* GPLMUX63 */
402 1, /* GPLMUX64 */
403 1, /* GPLMUX65 */
404 1, /* GPLMUX66 */
405 1, /* GPLMUX67 */
406 1, /* GPLMUX68 */
407 1, /* GPLMUX69 */
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411 0, /* RGMII1USEFPGA */
412 0, /* SPIS0USEFPGA */
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414 0, /* I2C0USEFPGA */
415 0, /* SDMMCUSEFPGA */
416 0, /* QSPIUSEFPGA */
417 0, /* SPIS1USEFPGA */
418 0, /* RGMII0USEFPGA */
419 0, /* UART1USEFPGA */
420 0, /* CAN1USEFPGA */
421 0, /* USB1USEFPGA */
422 0, /* I2C3USEFPGA */
423 0, /* I2C2USEFPGA */
424 0, /* I2C1USEFPGA */
425 0, /* SPIM1USEFPGA */
426 0, /* USB0USEFPGA */
427 0 /* SPIM0USEFPGA */
428};
429#endif /* CONFIG_TARGET_SOCFPGA_ARRIA5 */