blob: 38541103eaaf71dd0618d56e0d0eb5269c1f9396 [file] [log] [blame]
Dinh Nguyenc3364da2015-09-01 17:41:52 -05001/*
2 * Altera SoCFPGA PinMux configuration
3 *
4 * SPDX-License-Identifier: BSD-3-Clause
5 */
6
7#ifndef __SOCFPGA_PINMUX_CONFIG_H__
8#define __SOCFPGA_PINMUX_CONFIG_H__
9
10/* pin MUX configuration data */
11const u8 sys_mgr_init_table[] = {
12 0, /* EMACIO0 */
13 2, /* EMACIO1 */
14 2, /* EMACIO2 */
15 2, /* EMACIO3 */
16 2, /* EMACIO4 */
17 2, /* EMACIO5 */
18 2, /* EMACIO6 */
19 2, /* EMACIO7 */
20 2, /* EMACIO8 */
21 0, /* EMACIO9 */
22 2, /* EMACIO10 */
23 2, /* EMACIO11 */
24 2, /* EMACIO12 */
25 2, /* EMACIO13 */
26 0, /* EMACIO14 */
27 0, /* EMACIO15 */
28 0, /* EMACIO16 */
29 0, /* EMACIO17 */
30 0, /* EMACIO18 */
31 0, /* EMACIO19 */
32 3, /* FLASHIO0 */
33 0, /* FLASHIO1 */
34 3, /* FLASHIO2 */
35 3, /* FLASHIO3 */
36 0, /* FLASHIO4 */
37 0, /* FLASHIO5 */
38 0, /* FLASHIO6 */
39 0, /* FLASHIO7 */
40 0, /* FLASHIO8 */
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42 3, /* FLASHIO10 */
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187 1, /* GPLMUX58 */
188 1, /* GPLMUX59 */
189 1, /* GPLMUX60 */
190 1, /* GPLMUX61 */
191 1, /* GPLMUX62 */
192 1, /* GPLMUX63 */
193 1, /* GPLMUX64 */
194 1, /* GPLMUX65 */
195 1, /* GPLMUX66 */
196 1, /* GPLMUX67 */
197 1, /* GPLMUX68 */
198 1, /* GPLMUX69 */
199 1, /* GPLMUX70 */
200 0, /* NANDUSEFPGA */
201 0, /* UART0USEFPGA */
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203 0, /* SPIS0USEFPGA */
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205 0, /* I2C0USEFPGA */
206 0, /* SDMMCUSEFPGA */
207 0, /* QSPIUSEFPGA */
208 0, /* SPIS1USEFPGA */
209 0, /* RGMII0USEFPGA */
210 0, /* UART1USEFPGA */
211 0, /* CAN1USEFPGA */
212 0, /* USB1USEFPGA */
213 0, /* I2C3USEFPGA */
214 0, /* I2C2USEFPGA */
215 0, /* I2C1USEFPGA */
216 0, /* SPIM1USEFPGA */
217 0, /* USB0USEFPGA */
218 0 /* SPIM0USEFPGA */
219};
220#endif /* __SOCFPGA_PINMUX_CONFIG_H__ */