Blame - drivers/ram/k3-ddrss/j721e/lpddr4_ctl_regs.h - filogic/uboot

blob: 9363035d29befe0f6f5a875bc22bc72ae0960d95 [file] [log] [blame]

Kevin Scholz	521a4ef	2019-10-07 19:26:36 +0530	[diff] [blame]	1	/* SPDX-License-Identifier: BSD-3-Clause */
Dave Gerlach	d712b36	2021-05-11 10:22:11 -0500	[diff] [blame]	2	/*
				3	* Cadence DDR Driver
Kevin Scholz	521a4ef	2019-10-07 19:26:36 +0530	[diff] [blame]	4	*
Bryan Brattlof	85b5cc8	2022-10-24 16:53:28 -0500	[diff] [blame^]	5	* Copyright (C) 2012-2022 Cadence Design Systems, Inc.
				6	* Copyright (C) 2018-2022 Texas Instruments Incorporated - https://www.ti.com/
Kevin Scholz	521a4ef	2019-10-07 19:26:36 +0530	[diff] [blame]	7	*/
				8
				9	#ifndef REG_LPDDR4_CTL_REGS_H_
				10	#define REG_LPDDR4_CTL_REGS_H_
				11
				12	#include "lpddr4_ddr_controller_macros.h"
				13	#include "lpddr4_pi_macros.h"
				14	#include "lpddr4_data_slice_0_macros.h"
				15	#include "lpddr4_data_slice_1_macros.h"
				16	#include "lpddr4_data_slice_2_macros.h"
				17	#include "lpddr4_data_slice_3_macros.h"
				18	#include "lpddr4_address_slice_0_macros.h"
				19	#include "lpddr4_phy_core_macros.h"
				20
				21	typedef struct __attribute__((packed)) lpddr4_ctlregs_s {
Dave Gerlach	77b7037	2021-05-11 10:22:08 -0500	[diff] [blame]	22	volatile u32 DENALI_CTL_0;
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