Blame - board/overo/overo.h - filogic/uboot

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				2	* (C) Copyright 2008
				3	* Steve Sakoman <steve@sakoman.com>
				4	*
Wolfgang Denk	d79de1d	2013-07-08 09:37:19 +0200	[diff] [blame]	5	* SPDX-License-Identifier: GPL-2.0+
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				7	#ifndef _OVERO_H_
				8	#define _OVERO_H_
				9
				10	const omap3_sysinfo sysinfo = {
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	11	DDR_STACKED,
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	12	"Gumstix Overo board",
				13	#if defined(CONFIG_ENV_IS_IN_ONENAND)
				14	"OneNAND",
				15	#else
				16	"NAND",
				17	#endif
				18	};
				19
Andreas Müller	785f1f0	2012-01-04 15:26:25 +0000	[diff] [blame]	20	/* overo revisions */
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				23	#define REVISION_2 0x2
Steve Sakoman	9f32a9e	2013-07-24 12:22:34 -0700	[diff] [blame]	24	#define REVISION_3 0x3
Andreas Müller	785f1f0	2012-01-04 15:26:25 +0000	[diff] [blame]	25
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	26	/*
				27	* IEN - Input Enable
				28	* IDIS - Input Disable
				29	* PTD - Pull type Down
				30	* PTU - Pull type Up
				31	* DIS - Pull type selection is inactive
				32	* EN - Pull type selection is active
				33	* M0 - Mode 0
				34	* The commented string gives the final mux configuration for that pin
				35	*/
				36	#define MUX_OVERO() \
				37	/SDRC/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	38	MUX_VAL(CP(SDRC_D0), (IEN \| PTD \| DIS \| M0)) /SDRC_D0/\
				39	MUX_VAL(CP(SDRC_D1), (IEN \| PTD \| DIS \| M0)) /SDRC_D1/\
				40	MUX_VAL(CP(SDRC_D2), (IEN \| PTD \| DIS \| M0)) /SDRC_D2/\
				41	MUX_VAL(CP(SDRC_D3), (IEN \| PTD \| DIS \| M0)) /SDRC_D3/\
				42	MUX_VAL(CP(SDRC_D4), (IEN \| PTD \| DIS \| M0)) /SDRC_D4/\
				43	MUX_VAL(CP(SDRC_D5), (IEN \| PTD \| DIS \| M0)) /SDRC_D5/\
				44	MUX_VAL(CP(SDRC_D6), (IEN \| PTD \| DIS \| M0)) /SDRC_D6/\
				45	MUX_VAL(CP(SDRC_D7), (IEN \| PTD \| DIS \| M0)) /SDRC_D7/\
				46	MUX_VAL(CP(SDRC_D8), (IEN \| PTD \| DIS \| M0)) /SDRC_D8/\
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				50	MUX_VAL(CP(SDRC_D12), (IEN \| PTD \| DIS \| M0)) /SDRC_D12/\
				51	MUX_VAL(CP(SDRC_D13), (IEN \| PTD \| DIS \| M0)) /SDRC_D13/\
				52	MUX_VAL(CP(SDRC_D14), (IEN \| PTD \| DIS \| M0)) /SDRC_D14/\
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				106	/* - MMC1_WP*/\
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				202	MUX_VAL(CP(MMC2_DAT5), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_DAT1/\
				203	MUX_VAL(CP(MMC2_DAT6), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_CMD/\
Steve Sakoman	541ce99	2010-08-24 10:37:29 -0700	[diff] [blame]	204	MUX_VAL(CP(MMC2_DAT7), (IEN \| PTU \| EN \| M4)) /GPIO_139/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	205	/Bluetooth/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	206	MUX_VAL(CP(MCBSP3_DX), (IEN \| PTD \| DIS \| M1)) /UART2_CTS/\
				207	MUX_VAL(CP(MCBSP3_DR), (IDIS \| PTD \| DIS \| M1)) /UART2_RTS/\
				208	MUX_VAL(CP(MCBSP3_CLKX), (IDIS \| PTD \| DIS \| M1)) /UART2_TX/\
				209	MUX_VAL(CP(MCBSP3_FSX), (IEN \| PTD \| DIS \| M1)) /UART2_RX/\
				210	MUX_VAL(CP(UART2_CTS), (IEN \| PTD \| DIS \| M4)) /GPIO_144 - LCD_EN/\
				211	MUX_VAL(CP(UART2_RTS), (IEN \| PTD \| DIS \| M4)) /GPIO_145/\
				212	MUX_VAL(CP(UART2_TX), (IEN \| PTD \| DIS \| M4)) /GPIO_146/\
				213	MUX_VAL(CP(UART2_RX), (IEN \| PTD \| DIS \| M4)) /GPIO_147/\
				214	MUX_VAL(CP(UART1_TX), (IDIS \| PTD \| DIS \| M0)) /UART1_TX/\
				215	MUX_VAL(CP(UART1_RTS), (IEN \| PTU \| DIS \| M4)) /GPIO_149/ \
				216	MUX_VAL(CP(UART1_CTS), (IEN \| PTU \| DIS \| M4)) /GPIO_150-MMC3_WP/\
				217	MUX_VAL(CP(UART1_RX), (IEN \| PTD \| DIS \| M0)) /UART1_RX/\
				218	MUX_VAL(CP(MCBSP4_CLKX), (IEN \| PTD \| DIS \| M0)) /McBSP4_CLKX/\
				219	MUX_VAL(CP(MCBSP4_DR), (IEN \| PTD \| DIS \| M0)) /McBSP4_DR/\
				220	MUX_VAL(CP(MCBSP4_DX), (IEN \| PTD \| DIS \| M0)) /McBSP4_DX/\
				221	MUX_VAL(CP(MCBSP4_FSX), (IEN \| PTD \| DIS \| M0)) /McBSP4_FSX/\
				222	MUX_VAL(CP(MCBSP1_CLKR), (IEN \| PTD \| DIS \| M0)) /McBSP1_CLKR/\
				223	MUX_VAL(CP(MCBSP1_FSR), (IEN \| PTD \| DIS \| M0)) /McBSP1_FSR/\
				224	MUX_VAL(CP(MCBSP1_DX), (IEN \| PTD \| DIS \| M0)) /McBSP1_DX/\
				225	MUX_VAL(CP(MCBSP1_DR), (IEN \| PTD \| DIS \| M0)) /McBSP1_DR/\
				226	MUX_VAL(CP(MCBSP_CLKS), (IEN \| PTU \| DIS \| M0)) /McBSP_CLKS/\
				227	MUX_VAL(CP(MCBSP1_FSX), (IEN \| PTD \| DIS \| M0)) /McBSP1_FSX/\
				228	MUX_VAL(CP(MCBSP1_CLKX), (IEN \| PTD \| DIS \| M0)) /McBSP1_CLKX/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	229	/Serial Interface/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	230	MUX_VAL(CP(UART3_CTS_RCTX), (IEN \| PTD \| EN \| M0)) /UART3_CTS_RCTX/\
				231	MUX_VAL(CP(UART3_RTS_SD), (IEN \| PTU \| EN \| M4)) /GPIO_164 W2W_/\
				232	/* BT_NRESET*/\
				233	MUX_VAL(CP(UART3_RX_IRRX), (IEN \| PTU \| EN \| M0)) /UART3_RX_IRRX/\
				234	MUX_VAL(CP(UART3_TX_IRTX), (IDIS \| PTD \| DIS \| M0)) /UART3_TX_IRTX/\
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				242	MUX_VAL(CP(HSUSB0_DATA3), (IEN \| PTD \| DIS \| M0)) /HSUSB0_DATA3/\
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				244	MUX_VAL(CP(HSUSB0_DATA5), (IEN \| PTD \| DIS \| M0)) /HSUSB0_DATA5/\
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				250	/* - USBH_CPEN*/\
				251	MUX_VAL(CP(I2C2_SDA), (IEN \| PTU \| EN \| M4)) /GPIO_183/\
				252	/* - USBH_RESET*/\
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				258	MUX_VAL(CP(MCSPI1_CLK), (IEN \| PTD \| DIS \| M0)) /McSPI1_CLK/\
				259	MUX_VAL(CP(MCSPI1_SIMO), (IEN \| PTD \| DIS \| M0)) /McSPI1_SIMO /\
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				262	MUX_VAL(CP(MCSPI1_CS1), (IDIS \| PTD \| EN \| M0)) /McSPI1_CS1/\
Olof Johansson	4963f92	2009-09-29 10:22:45 -0400	[diff] [blame]	263	MUX_VAL(CP(MCSPI1_CS2), (IEN \| PTU \| DIS \| M4)) /GPIO_176 /\
				264	/* - LAN_INTR */\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	265	MUX_VAL(CP(MCSPI1_CS3), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA2/\
				266	MUX_VAL(CP(MCSPI2_CLK), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA7/\
				267	MUX_VAL(CP(MCSPI2_SIMO), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA4/\
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				270	MUX_VAL(CP(MCSPI2_CS1), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA3/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	271	/Control and debug /\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	272	MUX_VAL(CP(SYS_32K), (IEN \| PTD \| DIS \| M0)) /SYS_32K/\
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Steve Sakoman	9aff406	2011-09-30 09:04:14 +0000	[diff] [blame]	283	MUX_VAL(CP(SYS_CLKOUT1), (IEN \| PTU \| EN \| M4)) /GPIO_10/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	284	MUX_VAL(CP(SYS_CLKOUT2), (IEN \| PTU \| EN \| M4)) /GPIO_186/\
Steve Sakoman	3a00c66	2010-02-16 10:00:45 -0800	[diff] [blame]	285	MUX_VAL(CP(ETK_CLK_ES2), (IEN \| PTU \| EN \| M2)) /MMC3_CLK/\
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				290	/* - W2W_NRESET*/\
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Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	304	/* die to die */\
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				363	MUX_VAL(CP(D2D_SWRITE), (IEN \| PTD \| DIS \| M0)) /d2d_swrite/\
				364	MUX_VAL(CP(D2D_MREAD), (IEN \| PTD \| DIS \| M0)) /d2d_mread/\
				365	MUX_VAL(CP(D2D_SREAD), (IEN \| PTD \| DIS \| M0)) /d2d_sread/\
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				369	MUX_VAL(CP(SDRC_CKE1), (IDIS \| PTU \| EN \| M0)) /sdrc_cke1/
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	370
Steve Sakoman	541ce99	2010-08-24 10:37:29 -0700	[diff] [blame]	371	#define MUX_OVERO_SDIO2_DIRECT() \
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				375	MUX_VAL(CP(MMC2_DAT1), (IEN \| PTU \| EN \| M0)) /MMC2_DAT1/\
				376	MUX_VAL(CP(MMC2_DAT2), (IEN \| PTU \| EN \| M0)) /MMC2_DAT2/\
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				380	MUX_VAL(CP(MMC2_DAT6), (IEN \| PTU \| EN \| M0)) /MMC2_DAT6/\
				381	MUX_VAL(CP(MMC2_DAT7), (IEN \| PTU \| EN \| M0)) /MMC2_DAT7/\
				382	MUX_VAL(CP(MMC1_DAT4), (IEN \| PTD \| EN \| M4)) /GPIO_126/\
				383	MUX_VAL(CP(MMC1_DAT5), (IEN \| PTU \| EN \| M4)) /GPIO_127/\
				384	MUX_VAL(CP(MMC1_DAT6), (IEN \| PTU \| EN \| M4)) /GPIO_128/\
				385	MUX_VAL(CP(MMC1_DAT7), (IEN \| PTU \| EN \| M4)) /GPIO_129/
				386
				387	#define MUX_OVERO_SDIO2_TRANSCEIVER() \
				388	MUX_VAL(CP(MMC2_CLK), (IEN \| PTU \| EN \| M0)) /MMC2_CLK/\
				389	MUX_VAL(CP(MMC2_CMD), (IEN \| PTU \| EN \| M0)) /MMC2_CMD/\
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				406
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