blob: a9406060edc3a22c278298f22a46e3cc03e1c890 [file] [log] [blame]
Holger Brunckddef8892020-02-19 19:55:14 +01001/* SPDX-License-Identifier: BSD-3-Clause */
2/*
3 * Altera SoCFPGA PinMux configuration
4 */
5
6#ifndef __SOCFPGA_PINMUX_CONFIG_H__
7#define __SOCFPGA_PINMUX_CONFIG_H__
8
9const u8 sys_mgr_init_table[] = {
10 3, /* EMACIO0 */
11 3, /* EMACIO1 */
12 3, /* EMACIO2 */
13 3, /* EMACIO3 */
14 3, /* EMACIO4 */
15 3, /* EMACIO5 */
16 3, /* EMACIO6 */
17 3, /* EMACIO7 */
18 3, /* EMACIO8 */
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21 3, /* EMACIO11 */
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23 3, /* EMACIO13 */
24 0, /* EMACIO14 */
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33 0, /* FLASHIO3 */
34 0, /* FLASHIO4 */
35 0, /* FLASHIO5 */
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41 0, /* FLASHIO11 */
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191 1, /* GPLMUX64 */
192 1, /* GPLMUX65 */
193 1, /* GPLMUX66 */
194 1, /* GPLMUX67 */
195 1, /* GPLMUX68 */
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201 0, /* SPIS0USEFPGA */
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204 0, /* SDMMCUSEFPGA */
205 0, /* QSPIUSEFPGA */
206 0, /* SPIS1USEFPGA */
207 0, /* RGMII0USEFPGA */
208 0, /* UART1USEFPGA */
209 0, /* CAN1USEFPGA */
210 0, /* USB1USEFPGA */
211 0, /* I2C3USEFPGA */
212 0, /* I2C2USEFPGA */
213 0, /* I2C1USEFPGA */
214 1, /* SPIM1USEFPGA */
215 0, /* USB0USEFPGA */
216 0 /* SPIM0USEFPGA */
217};
218#endif /* __SOCFPGA_PINMUX_CONFIG_H__ */