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| 5 | * Copyright (C) 2015 Paul Kocialkowski <contact@paulk.fr> |
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| 7 | |
| 8 | #ifndef _SNIPER_H_ |
| 9 | #define _SNIPER_H_ |
| 10 | |
| 11 | #include <asm/arch/mux.h> |
| 12 | |
| 13 | #define MUX_SNIPER() \ |
| 14 | /* SDRC */ \ |
Paul Kocialkowski | d90f883 | 2016-02-26 13:18:47 +0100 | [diff] [blame] | 15 | MUX_VAL(CP(SDRC_D0), (IEN | PTD | DIS | M0)) /* sdrc_d0 */\ |
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Paul Kocialkowski | 3dee000 | 2015-07-20 15:17:11 +0200 | [diff] [blame] | 52 | /* GPMC */ \ |
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Paul Kocialkowski | 3dee000 | 2015-07-20 15:17:11 +0200 | [diff] [blame] | 97 | /* DSS */ \ |
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| 133 | MUX_VAL(CP(CAM_D1), (IEN | PTD | DIS | M2)) /* csi2_dy2 */ \ |
| 134 | MUX_VAL(CP(CAM_D2), (IDIS | PTD | EN | M4)) /* gpio_101 */ \ |
| 135 | MUX_VAL(CP(CAM_D3), (IDIS | PTD | DIS | M7)) /* safe_mode */ \ |
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| 139 | MUX_VAL(CP(CAM_D7), (IEN | PTD | DIS | M0)) /* cam_d7 */ \ |
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| 142 | MUX_VAL(CP(CAM_D10), (IEN | PTD | DIS | M0)) /* cam_d10 */ \ |
| 143 | MUX_VAL(CP(CAM_D11), (IEN | PTD | DIS | M0)) /* cam_d11 */ \ |
| 144 | MUX_VAL(CP(CAM_XCLKB), (IEN | PTD | DIS | M0)) /* cam_xclkb */ \ |
| 145 | MUX_VAL(CP(CAM_WEN), (IDIS | PTD | DIS | M4)) /* gpio_167 */ \ |
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| 151 | MUX_VAL(CP(CSI2_DY1), (IEN | PTD | DIS | M0)) /* csi2_dy1 */ \ |
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| 155 | MUX_VAL(CP(MCBSP2_DR), (IEN | PTD | DIS | M0)) /* mcbsp2_dr */ \ |
| 156 | MUX_VAL(CP(MCBSP2_DX), (IDIS | PTD | DIS | M0)) /* mcbsp2_dx */ \ |
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Paul Kocialkowski | 3dee000 | 2015-07-20 15:17:11 +0200 | [diff] [blame] | 168 | /* MMC2 */ \ |
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| 174 | MUX_VAL(CP(MMC2_DAT3), (IEN | PTD | DIS | M0)) /* mmc2_dat3 */ \ |
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Paul Kocialkowski | 3dee000 | 2015-07-20 15:17:11 +0200 | [diff] [blame] | 179 | /* MCBSP3 */ \ |
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| 183 | MUX_VAL(CP(MCBSP3_FSX), (IEN | PTD | DIS | M0)) /* mcbsp3_fsx */ \ |
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| 251 | MUX_VAL(CP(MCSPI2_CS1), (IDIS | PTD | DIS | M4)) /* gpio_182 */ \ |
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| 348 | MUX_VAL(CP(D2D_SWAKEUP), (IEN | PTD | EN | M0)) /* d2d_swakeup */ \ |
| 349 | MUX_VAL(CP(D2D_IDLEREQ), (IEN | PTD | DIS | M0)) /* d2d_idlereq */ \ |
| 350 | MUX_VAL(CP(D2D_IDLEACK), (IEN | PTU | EN | M0)) /* d2d_idleack */ \ |
| 351 | MUX_VAL(CP(D2D_MWRITE), (IEN | PTD | DIS | M0)) /* d2d_mwrite */ \ |
| 352 | MUX_VAL(CP(D2D_SWRITE), (IEN | PTD | DIS | M0)) /* d2d_swrite */ \ |
| 353 | MUX_VAL(CP(D2D_MREAD), (IEN | PTD | DIS | M0)) /* d2d_mread */ \ |
| 354 | MUX_VAL(CP(D2D_SREAD), (IEN | PTD | DIS | M0)) /* d2d_sread */ \ |
| 355 | MUX_VAL(CP(D2D_MBUSFLAG), (IEN | PTD | DIS | M0)) /* d2d_mbusflag */ \ |
| 356 | MUX_VAL(CP(D2D_SBUSFLAG), (IEN | PTD | DIS | M0)) /* d2d_sbusflag */ \ |
| 357 | MUX_VAL(CP(SDRC_CKE0), (IDIS | PTD | DIS | M0)) /* sdrc_cke0 */ \ |
| 358 | MUX_VAL(CP(SDRC_CKE1), (IDIS | PTD | DIS | M0)) /* sdrc_cke1 */ \ |
| 359 | MUX_VAL(CP(GPIO127), (IEN | PTD | DIS | M7)) /* safe_mode */ \ |
| 360 | MUX_VAL(CP(GPIO126), (IDIS | PTD | DIS | M4)) /* gpio_126 */ \ |
| 361 | MUX_VAL(CP(GPIO128), (IDIS | PTD | DIS | M4)) /* gpio_128 */ \ |
| 362 | MUX_VAL(CP(GPIO129), (IEN | PTD | DIS | M4)) /* gpio_129 */ |
Paul Kocialkowski | 3dee000 | 2015-07-20 15:17:11 +0200 | [diff] [blame] | 363 | |
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