blob: 723bab584c37b5997b8f69762589b858ecf20e74 [file] [log] [blame]
/* SPDX-License-Identifier: GPL-2.0+ */
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* Copyright 2020 NXP
*/
#ifndef _IMX8ULP_REGS_H_
#define _IMX8ULP_REGS_H_
#define ARCH_MXC
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#include <linux/sizes.h>
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#define CMC1_BASE_ADDR 0x29240000
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#define WDG3_RBASE 0x292a0000UL
#define SIM_SEC_BASE_ADDR 0x2802B000
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#define CFG1_PLL2CFG_ADDR 0x292C0510
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#define LPUART_BASE LPUART5_RBASE
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#define USB_BASE_ADDR USBOTG0_RBASE
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#define AVD_SIM_LPDDR_CTRL2 (AVD_SIM_BASE_ADDR + 0x18)
#define FEC_QUIRK_ENET_MAC
#if !(defined(__KERNEL_STRICT_NAMES) || defined(__ASSEMBLY__))
#include <asm/types.h>
struct mu_type {
u32 ver;
u32 par;
u32 cr;
u32 sr;
u32 reserved0[60];
u32 fcr;
u32 fsr;
u32 reserved1[2];
u32 gier;
u32 gcr;
u32 gsr;
u32 reserved2;
u32 tcr;
u32 tsr;
u32 rcr;
u32 rsr;
u32 reserved3[52];
u32 tr[16];
u32 reserved4[16];
u32 rr[16];
u32 reserved5[14];
u32 mu_attr;
};
struct usbphy_regs {
u32 usbphy_pwd; /* 0x000 */
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u32 usbphy_tx_set; /* 0x014 */
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u32 usbphy_tx_tog; /* 0x01c */
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u32 usbphy_rx_set; /* 0x024 */
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u32 usbphy_rx_tog; /* 0x02c */
u32 usbphy_ctrl; /* 0x030 */
u32 usbphy_ctrl_set; /* 0x034 */
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u32 usbphy_ctrl_tog; /* 0x03c */
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u32 usbphy_debug; /* 0x050 */
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u32 usbphy_debug0_status; /* 0x060 */
u32 reserved1[3];
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u32 usbphy_version; /* 0x080 */
u32 reserved2[7];
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u32 usb1_pll_480_ctrl_tog; /* 0x0ac */
u32 reserved3[4];
u32 usb1_vbus_detect; /* 0xc0 */
u32 usb1_vbus_detect_set; /* 0xc4 */
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u32 usb1_vbus_detect_tog; /* 0xcc */
u32 usb1_vbus_det_stat; /* 0xd0 */
u32 reserved4[3];
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u32 usb1_chrg_det_stat; /* 0xf0 */
u32 reserved5[3];
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};
#endif
#endif