| Jeenu Viswambharan | d27ad95 | 2017-07-19 17:27:49 +0100 | [diff] [blame^] | 1 | /* |
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| 4 | * SPDX-License-Identifier: BSD-3-Clause | ||||
| 5 | */ | ||||
| 6 | |||||
| 7 | /dts-v1/; | ||||
| 8 | |||||
| 9 | /include/ "fvp-base-gicv3-psci-common.dtsi" | ||||
| 10 | |||||
| 11 | &CPU0 { | ||||
| 12 | reg = <0x0 0x0>; | ||||
| 13 | }; | ||||
| 14 | |||||
| 15 | &CPU1 { | ||||
| 16 | reg = <0x0 0x100>; | ||||
| 17 | }; | ||||
| 18 | |||||
| 19 | &CPU2 { | ||||
| 20 | reg = <0x0 0x200>; | ||||
| 21 | }; | ||||
| 22 | |||||
| 23 | &CPU3 { | ||||
| 24 | reg = <0x0 0x300>; | ||||
| 25 | }; | ||||
| 26 | |||||
| 27 | &CPU4 { | ||||
| 28 | reg = <0x0 0x10000>; | ||||
| 29 | }; | ||||
| 30 | |||||
| 31 | &CPU5 { | ||||
| 32 | reg = <0x0 0x10100>; | ||||
| 33 | }; | ||||
| 34 | |||||
| 35 | &CPU6 { | ||||
| 36 | reg = <0x0 0x10200>; | ||||
| 37 | }; | ||||
| 38 | |||||
| 39 | &CPU7 { | ||||
| 40 | reg = <0x0 0x10300>; | ||||
| 41 | }; | ||||