Blame - board/overo/overo.h - filogic/uboot

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				2	* (C) Copyright 2008
				3	* Steve Sakoman <steve@sakoman.com>
				4	*
Wolfgang Denk	d79de1d	2013-07-08 09:37:19 +0200	[diff] [blame]	5	* SPDX-License-Identifier: GPL-2.0+
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				7	#ifndef _OVERO_H_
				8	#define _OVERO_H_
				9
				10	const omap3_sysinfo sysinfo = {
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	11	DDR_STACKED,
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	12	"Gumstix Overo board",
				13	#if defined(CONFIG_ENV_IS_IN_ONENAND)
				14	"OneNAND",
				15	#else
				16	"NAND",
				17	#endif
				18	};
				19
Andreas Müller	785f1f0	2012-01-04 15:26:25 +0000	[diff] [blame]	20	/* overo revisions */
				21	#define REVISION_0 0x0
				22	#define REVISION_1 0x1
				23	#define REVISION_2 0x2
				24
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	25	/*
				26	* IEN - Input Enable
				27	* IDIS - Input Disable
				28	* PTD - Pull type Down
				29	* PTU - Pull type Up
				30	* DIS - Pull type selection is inactive
				31	* EN - Pull type selection is active
				32	* M0 - Mode 0
				33	* The commented string gives the final mux configuration for that pin
				34	*/
				35	#define MUX_OVERO() \
				36	/SDRC/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	37	MUX_VAL(CP(SDRC_D0), (IEN \| PTD \| DIS \| M0)) /SDRC_D0/\
				38	MUX_VAL(CP(SDRC_D1), (IEN \| PTD \| DIS \| M0)) /SDRC_D1/\
				39	MUX_VAL(CP(SDRC_D2), (IEN \| PTD \| DIS \| M0)) /SDRC_D2/\
				40	MUX_VAL(CP(SDRC_D3), (IEN \| PTD \| DIS \| M0)) /SDRC_D3/\
				41	MUX_VAL(CP(SDRC_D4), (IEN \| PTD \| DIS \| M0)) /SDRC_D4/\
				42	MUX_VAL(CP(SDRC_D5), (IEN \| PTD \| DIS \| M0)) /SDRC_D5/\
				43	MUX_VAL(CP(SDRC_D6), (IEN \| PTD \| DIS \| M0)) /SDRC_D6/\
				44	MUX_VAL(CP(SDRC_D7), (IEN \| PTD \| DIS \| M0)) /SDRC_D7/\
				45	MUX_VAL(CP(SDRC_D8), (IEN \| PTD \| DIS \| M0)) /SDRC_D8/\
				46	MUX_VAL(CP(SDRC_D9), (IEN \| PTD \| DIS \| M0)) /SDRC_D9/\
				47	MUX_VAL(CP(SDRC_D10), (IEN \| PTD \| DIS \| M0)) /SDRC_D10/\
				48	MUX_VAL(CP(SDRC_D11), (IEN \| PTD \| DIS \| M0)) /SDRC_D11/\
				49	MUX_VAL(CP(SDRC_D12), (IEN \| PTD \| DIS \| M0)) /SDRC_D12/\
				50	MUX_VAL(CP(SDRC_D13), (IEN \| PTD \| DIS \| M0)) /SDRC_D13/\
				51	MUX_VAL(CP(SDRC_D14), (IEN \| PTD \| DIS \| M0)) /SDRC_D14/\
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				105	/* - MMC1_WP*/\
				106	MUX_VAL(CP(GPMC_NCS4), (IDIS \| PTU \| EN \| M0)) /GPMC_nCS4/\
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				202	MUX_VAL(CP(MMC2_DAT6), (IEN \| PTU \| EN \| M1)) /MMC2_DIR_CMD/\
Steve Sakoman	541ce99	2010-08-24 10:37:29 -0700	[diff] [blame]	203	MUX_VAL(CP(MMC2_DAT7), (IEN \| PTU \| EN \| M4)) /GPIO_139/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	204	/Bluetooth/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	205	MUX_VAL(CP(MCBSP3_DX), (IEN \| PTD \| DIS \| M1)) /UART2_CTS/\
				206	MUX_VAL(CP(MCBSP3_DR), (IDIS \| PTD \| DIS \| M1)) /UART2_RTS/\
				207	MUX_VAL(CP(MCBSP3_CLKX), (IDIS \| PTD \| DIS \| M1)) /UART2_TX/\
				208	MUX_VAL(CP(MCBSP3_FSX), (IEN \| PTD \| DIS \| M1)) /UART2_RX/\
				209	MUX_VAL(CP(UART2_CTS), (IEN \| PTD \| DIS \| M4)) /GPIO_144 - LCD_EN/\
				210	MUX_VAL(CP(UART2_RTS), (IEN \| PTD \| DIS \| M4)) /GPIO_145/\
				211	MUX_VAL(CP(UART2_TX), (IEN \| PTD \| DIS \| M4)) /GPIO_146/\
				212	MUX_VAL(CP(UART2_RX), (IEN \| PTD \| DIS \| M4)) /GPIO_147/\
				213	MUX_VAL(CP(UART1_TX), (IDIS \| PTD \| DIS \| M0)) /UART1_TX/\
				214	MUX_VAL(CP(UART1_RTS), (IEN \| PTU \| DIS \| M4)) /GPIO_149/ \
				215	MUX_VAL(CP(UART1_CTS), (IEN \| PTU \| DIS \| M4)) /GPIO_150-MMC3_WP/\
				216	MUX_VAL(CP(UART1_RX), (IEN \| PTD \| DIS \| M0)) /UART1_RX/\
				217	MUX_VAL(CP(MCBSP4_CLKX), (IEN \| PTD \| DIS \| M0)) /McBSP4_CLKX/\
				218	MUX_VAL(CP(MCBSP4_DR), (IEN \| PTD \| DIS \| M0)) /McBSP4_DR/\
				219	MUX_VAL(CP(MCBSP4_DX), (IEN \| PTD \| DIS \| M0)) /McBSP4_DX/\
				220	MUX_VAL(CP(MCBSP4_FSX), (IEN \| PTD \| DIS \| M0)) /McBSP4_FSX/\
				221	MUX_VAL(CP(MCBSP1_CLKR), (IEN \| PTD \| DIS \| M0)) /McBSP1_CLKR/\
				222	MUX_VAL(CP(MCBSP1_FSR), (IEN \| PTD \| DIS \| M0)) /McBSP1_FSR/\
				223	MUX_VAL(CP(MCBSP1_DX), (IEN \| PTD \| DIS \| M0)) /McBSP1_DX/\
				224	MUX_VAL(CP(MCBSP1_DR), (IEN \| PTD \| DIS \| M0)) /McBSP1_DR/\
				225	MUX_VAL(CP(MCBSP_CLKS), (IEN \| PTU \| DIS \| M0)) /McBSP_CLKS/\
				226	MUX_VAL(CP(MCBSP1_FSX), (IEN \| PTD \| DIS \| M0)) /McBSP1_FSX/\
				227	MUX_VAL(CP(MCBSP1_CLKX), (IEN \| PTD \| DIS \| M0)) /McBSP1_CLKX/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	228	/Serial Interface/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	229	MUX_VAL(CP(UART3_CTS_RCTX), (IEN \| PTD \| EN \| M0)) /UART3_CTS_RCTX/\
				230	MUX_VAL(CP(UART3_RTS_SD), (IEN \| PTU \| EN \| M4)) /GPIO_164 W2W_/\
				231	/* BT_NRESET*/\
				232	MUX_VAL(CP(UART3_RX_IRRX), (IEN \| PTU \| EN \| M0)) /UART3_RX_IRRX/\
				233	MUX_VAL(CP(UART3_TX_IRTX), (IDIS \| PTD \| DIS \| M0)) /UART3_TX_IRTX/\
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				235	MUX_VAL(CP(HSUSB0_STP), (IDIS \| PTU \| EN \| M0)) /HSUSB0_STP/\
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				240	MUX_VAL(CP(HSUSB0_DATA2), (IEN \| PTD \| DIS \| M0)) /HSUSB0_DATA2/\
				241	MUX_VAL(CP(HSUSB0_DATA3), (IEN \| PTD \| DIS \| M0)) /HSUSB0_DATA3/\
				242	MUX_VAL(CP(HSUSB0_DATA4), (IEN \| PTD \| DIS \| M0)) /HSUSB0_DATA4/\
				243	MUX_VAL(CP(HSUSB0_DATA5), (IEN \| PTD \| DIS \| M0)) /HSUSB0_DATA5/\
				244	MUX_VAL(CP(HSUSB0_DATA6), (IEN \| PTD \| DIS \| M0)) /HSUSB0_DATA6/\
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				249	/* - USBH_CPEN*/\
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				251	/* - USBH_RESET*/\
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				261	MUX_VAL(CP(MCSPI1_CS1), (IDIS \| PTD \| EN \| M0)) /McSPI1_CS1/\
Olof Johansson	4963f92	2009-09-29 10:22:45 -0400	[diff] [blame]	262	MUX_VAL(CP(MCSPI1_CS2), (IEN \| PTU \| DIS \| M4)) /GPIO_176 /\
				263	/* - LAN_INTR */\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	264	MUX_VAL(CP(MCSPI1_CS3), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA2/\
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				266	MUX_VAL(CP(MCSPI2_SIMO), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA4/\
				267	MUX_VAL(CP(MCSPI2_SOMI), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA5/\
				268	MUX_VAL(CP(MCSPI2_CS0), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA6/\
				269	MUX_VAL(CP(MCSPI2_CS1), (IEN \| PTD \| DIS \| M3)) /HSUSB2_DATA3/\
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	270	/Control and debug /\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	271	MUX_VAL(CP(SYS_32K), (IEN \| PTD \| DIS \| M0)) /SYS_32K/\
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Steve Sakoman	9aff406	2011-09-30 09:04:14 +0000	[diff] [blame]	282	MUX_VAL(CP(SYS_CLKOUT1), (IEN \| PTU \| EN \| M4)) /GPIO_10/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	283	MUX_VAL(CP(SYS_CLKOUT2), (IEN \| PTU \| EN \| M4)) /GPIO_186/\
Steve Sakoman	3a00c66	2010-02-16 10:00:45 -0800	[diff] [blame]	284	MUX_VAL(CP(ETK_CLK_ES2), (IEN \| PTU \| EN \| M2)) /MMC3_CLK/\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	285	MUX_VAL(CP(ETK_CTL_ES2), (IEN \| PTU \| EN \| M2)) /MMC3_CMD/\
				286	MUX_VAL(CP(ETK_D0_ES2), (IEN \| PTU \| EN \| M4)) /GPIO_14/\
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				289	/* - W2W_NRESET*/\
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Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	303	/* die to die */\
Olof Johansson	4c391e5	2009-09-28 08:19:30 -0400	[diff] [blame]	304	MUX_VAL(CP(D2D_MCAD1), (IEN \| PTD \| EN \| M0)) /d2d_mcad1/\
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				353	MUX_VAL(CP(D2D_N3GTDO), (IEN \| PTD \| DIS \| M0)) /d2d_n3gtdo/\
				354	MUX_VAL(CP(D2D_N3GTMS), (IEN \| PTD \| DIS \| M0)) /d2d_n3gtms/\
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				360	MUX_VAL(CP(D2D_IDLEACK), (IEN \| PTU \| EN \| M0)) /d2d_idleack/\
				361	MUX_VAL(CP(D2D_MWRITE), (IEN \| PTD \| DIS \| M0)) /d2d_mwrite/\
				362	MUX_VAL(CP(D2D_SWRITE), (IEN \| PTD \| DIS \| M0)) /d2d_swrite/\
				363	MUX_VAL(CP(D2D_MREAD), (IEN \| PTD \| DIS \| M0)) /d2d_mread/\
				364	MUX_VAL(CP(D2D_SREAD), (IEN \| PTD \| DIS \| M0)) /d2d_sread/\
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				368	MUX_VAL(CP(SDRC_CKE1), (IDIS \| PTU \| EN \| M0)) /sdrc_cke1/
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	369
Steve Sakoman	541ce99	2010-08-24 10:37:29 -0700	[diff] [blame]	370	#define MUX_OVERO_SDIO2_DIRECT() \
				371	MUX_VAL(CP(MMC2_CLK), (IEN \| PTU \| EN \| M0)) /MMC2_CLK/\
				372	MUX_VAL(CP(MMC2_CMD), (IEN \| PTU \| EN \| M0)) /MMC2_CMD/\
				373	MUX_VAL(CP(MMC2_DAT0), (IEN \| PTU \| EN \| M0)) /MMC2_DAT0/\
				374	MUX_VAL(CP(MMC2_DAT1), (IEN \| PTU \| EN \| M0)) /MMC2_DAT1/\
				375	MUX_VAL(CP(MMC2_DAT2), (IEN \| PTU \| EN \| M0)) /MMC2_DAT2/\
				376	MUX_VAL(CP(MMC2_DAT3), (IEN \| PTU \| EN \| M0)) /MMC2_DAT3/\
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				379	MUX_VAL(CP(MMC2_DAT6), (IEN \| PTU \| EN \| M0)) /MMC2_DAT6/\
				380	MUX_VAL(CP(MMC2_DAT7), (IEN \| PTU \| EN \| M0)) /MMC2_DAT7/\
				381	MUX_VAL(CP(MMC1_DAT4), (IEN \| PTD \| EN \| M4)) /GPIO_126/\
				382	MUX_VAL(CP(MMC1_DAT5), (IEN \| PTU \| EN \| M4)) /GPIO_127/\
				383	MUX_VAL(CP(MMC1_DAT6), (IEN \| PTU \| EN \| M4)) /GPIO_128/\
				384	MUX_VAL(CP(MMC1_DAT7), (IEN \| PTU \| EN \| M4)) /GPIO_129/
				385
				386	#define MUX_OVERO_SDIO2_TRANSCEIVER() \
				387	MUX_VAL(CP(MMC2_CLK), (IEN \| PTU \| EN \| M0)) /MMC2_CLK/\
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				405
Dirk Behme	220faba	2009-01-28 21:39:57 +0100	[diff] [blame]	406	#endif