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git01.mediatek.com / filogic / uboot / c31f901b7c095a32d4809608d6598ecd8fee50e4 / . / dts / upstream / Bindings / memory-controllers / ddr
tree: dc2059d41163fd1046b198ddb33d80318ccd13e8 [path history] [tgz]
  1. jedec,lpddr-channel.yaml
  2. jedec,lpddr-props.yaml
  3. jedec,lpddr2-timings.yaml
  4. jedec,lpddr2.yaml
  5. jedec,lpddr3-timings.yaml
  6. jedec,lpddr3.yaml
  7. jedec,lpddr4.yaml
  8. jedec,lpddr5.yaml